ECP5 support is no longer experimental
Signed-off-by: David Shah <dave@ds0.me>
This commit is contained in:
David Shah
parent
08cf545d9b
commit
98fe4438f1
@ -6,7 +6,7 @@ tool.
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Currently nextpnr supports:
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Currently nextpnr supports:
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* Lattice iCE40 devices supported by [Project IceStorm](http://www.clifford.at/icestorm/)
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* Lattice iCE40 devices supported by [Project IceStorm](http://www.clifford.at/icestorm/)
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* *(experimental)* Lattice ECP5 devices supported by [Project Trellis](https://github.com/SymbiFlow/prjtrellis)
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* Lattice ECP5 devices supported by [Project Trellis](https://github.com/SymbiFlow/prjtrellis)
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* *(experimental)* a "generic" back-end for user-defined architectures
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* *(experimental)* a "generic" back-end for user-defined architectures
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We hope to see Xilinx 7 Series thanks to
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We hope to see Xilinx 7 Series thanks to
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@ -106,12 +106,7 @@ make -j$(nproc)
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sudo make install
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sudo make install
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```
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```
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- For an ECP5 blinky on the 45k ULX3S board, first synthesise using `yosys blinky.ys` in `ecp5/synth`.
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- Examples of the ECP5 flow for a range of boards can be found in the [Project Trellis Examples](https://github.com/SymbiFlow/prjtrellis/tree/master/examples).
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- Then run ECP5 place-and route using `./nextpnr-ecp5 --json ecp5/synth/blinky.json --basecfg ecp5/synth/ulx3s_empty.config --textcfg ecp5/synth/ulx3s_out.config`
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- Create a bitstream using `ecppack ulx3s_out.config ulx3s.bit`
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- Note that `ulx3s_empty.config` contains fixed/unknown bits to be copied to the output bitstream
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- More examples of the ECP5 flow for a range of boards can be found in the [Project Trellis Examples](https://github.com/SymbiFlow/prjtrellis/tree/master/examples).
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### nextpnr-generic
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### nextpnr-generic
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@ -144,8 +144,7 @@ Nextpnr and other tools
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migrating to nextpnr.
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migrating to nextpnr.
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* If you are developing Verilog FPGA code targeted at the Lattice ECP5 and
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* If you are developing Verilog FPGA code targeted at the Lattice ECP5 and
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need an open source toolchain, you may consider the **extremely
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need an open source toolchain, there is also stable ECP5 support in Yosys and nextpnr.
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experimental** ECP5 support in Yosys and nextpnr.
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* If you are developing FPGA code in **VHDL** you will need to use either a
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* If you are developing FPGA code in **VHDL** you will need to use either a
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version of [Yosys with Verific support](https://github.com/YosysHQ/yosys/tree/master/frontends/verific) or the vendor provided tools due
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version of [Yosys with Verific support](https://github.com/YosysHQ/yosys/tree/master/frontends/verific) or the vendor provided tools due
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3
ecp5/synth/.gitignore
vendored
3
ecp5/synth/.gitignore
vendored
@ -1,3 +0,0 @@
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*.bit
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*_out.config
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@ -1,77 +0,0 @@
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module top(input clk_pin, input btn_pin, output [7:0] led_pin, output gpio0_pin);
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wire clk;
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wire [7:0] led;
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wire btn;
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wire gpio0;
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(* LOC="G2" *) (* IO_TYPE="LVCMOS33" *)
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TRELLIS_IO #(.DIR("INPUT")) clk_buf (.B(clk_pin), .O(clk));
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(* LOC="R1" *) (* IO_TYPE="LVCMOS33" *)
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TRELLIS_IO #(.DIR("INPUT")) btn_buf (.B(btn_pin), .O(btn));
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(* LOC="B2" *) (* IO_TYPE="LVCMOS33" *)
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TRELLIS_IO #(.DIR("OUTPUT")) led_buf_0 (.B(led_pin[0]), .I(led[0]));
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||||||
(* LOC="C2" *) (* IO_TYPE="LVCMOS33" *)
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||||||
TRELLIS_IO #(.DIR("OUTPUT")) led_buf_1 (.B(led_pin[1]), .I(led[1]));
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||||||
(* LOC="C1" *) (* IO_TYPE="LVCMOS33" *)
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||||||
TRELLIS_IO #(.DIR("OUTPUT")) led_buf_2 (.B(led_pin[2]), .I(led[2]));
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||||||
(* LOC="D2" *) (* IO_TYPE="LVCMOS33" *)
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||||||
TRELLIS_IO #(.DIR("OUTPUT")) led_buf_3 (.B(led_pin[3]), .I(led[3]));
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||||||
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||||||
(* LOC="D1" *) (* IO_TYPE="LVCMOS33" *)
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||||||
TRELLIS_IO #(.DIR("OUTPUT")) led_buf_4 (.B(led_pin[4]), .I(led[4]));
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|
||||||
(* LOC="E2" *) (* IO_TYPE="LVCMOS33" *)
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|
||||||
TRELLIS_IO #(.DIR("OUTPUT")) led_buf_5 (.B(led_pin[5]), .I(led[5]));
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||||||
(* LOC="E1" *) (* IO_TYPE="LVCMOS33" *)
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||||||
TRELLIS_IO #(.DIR("OUTPUT")) led_buf_6 (.B(led_pin[6]), .I(led[6]));
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|
||||||
(* LOC="H3" *) (* IO_TYPE="LVCMOS33" *)
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||||||
TRELLIS_IO #(.DIR("OUTPUT")) led_buf_7 (.B(led_pin[7]), .I(led[7]));
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||||||
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||||||
(* LOC="L2" *) (* IO_TYPE="LVCMOS33" *)
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||||||
TRELLIS_IO #(.DIR("OUTPUT")) gpio0_buf (.B(gpio0_pin), .I(gpio0));
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localparam ctr_width = 24;
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localparam ctr_max = 2**ctr_width - 1;
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reg [ctr_width-1:0] ctr = 0;
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reg [9:0] pwm_ctr = 0;
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reg dir = 0;
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always@(posedge clk) begin
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ctr <= btn ? ctr : (dir ? ctr - 1'b1 : ctr + 1'b1);
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if (ctr[ctr_width-1 : ctr_width-3] == 0 && dir == 1)
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dir <= 1'b0;
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||||||
else if (ctr[ctr_width-1 : ctr_width-3] == 7 && dir == 0)
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dir <= 1'b1;
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pwm_ctr <= pwm_ctr + 1'b1;
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||||||
end
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reg [9:0] brightness [0:7];
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localparam bright_max = 2**10 - 1;
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reg [7:0] led_reg;
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genvar i;
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generate
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for (i = 0; i < 8; i=i+1) begin
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always @ (posedge clk) begin
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if (ctr[ctr_width-1 : ctr_width-3] == i)
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brightness[i] <= bright_max;
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||||||
else if (ctr[ctr_width-1 : ctr_width-3] == (i - 1))
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||||||
brightness[i] <= ctr[ctr_width-4:ctr_width-13];
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||||||
else if (ctr[ctr_width-1 : ctr_width-3] == (i + 1))
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||||||
brightness[i] <= bright_max - ctr[ctr_width-4:ctr_width-13];
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||||||
else
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||||||
brightness[i] <= 0;
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||||||
led_reg[i] <= pwm_ctr < brightness[i];
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||||||
end
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||||||
end
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endgenerate
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assign led = led_reg;
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// Tie GPIO0, keep board from rebooting
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assign gpio0 = 1'b1;
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endmodule
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@ -1,2 +0,0 @@
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read_verilog blinky.v
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synth_ecp5 -noccu2 -nomux -nodram -json blinky.json
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@ -1,439 +0,0 @@
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.device LFE5U-45F
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.tile CIB_R10C3:PVT_COUNT2
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unknown: F2B0
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unknown: F3B0
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unknown: F5B0
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unknown: F11B0
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||||||
unknown: F13B0
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||||||
.tile CIB_R5C1:CIB_PLL1
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||||||
enum: CIB.JA3MUX 0
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||||||
enum: CIB.JB3MUX 0
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||||||
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||||||
.tile CIB_R5C89:CIB_PLL1
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||||||
enum: CIB.JA3MUX 0
|
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||||||
enum: CIB.JB3MUX 0
|
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||||||
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||||||
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||||||
.tile CIB_R70C3:CIB_PLL3
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||||||
enum: CIB.JA3MUX 0
|
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||||||
enum: CIB.JB3MUX 0
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.tile CIB_R70C42:VCIB_DCU0
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||||||
enum: CIB.JA1MUX 0
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||||||
enum: CIB.JA3MUX 0
|
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||||||
enum: CIB.JA5MUX 0
|
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||||||
enum: CIB.JA7MUX 0
|
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||||||
enum: CIB.JB1MUX 0
|
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||||||
enum: CIB.JB3MUX 0
|
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||||||
enum: CIB.JB5MUX 0
|
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||||||
enum: CIB.JB7MUX 0
|
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||||||
enum: CIB.JC0MUX 0
|
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||||||
enum: CIB.JC2MUX 0
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enum: CIB.JC4MUX 0
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||||||
enum: CIB.JC6MUX 0
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||||||
enum: CIB.JD0MUX 0
|
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||||||
enum: CIB.JD2MUX 0
|
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||||||
enum: CIB.JD4MUX 0
|
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||||||
enum: CIB.JD6MUX 0
|
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.tile CIB_R70C43:VCIB_DCUA
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enum: CIB.JA1MUX 0
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enum: CIB.JA3MUX 0
|
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||||||
enum: CIB.JA5MUX 0
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enum: CIB.JA7MUX 0
|
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||||||
enum: CIB.JB1MUX 0
|
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||||||
enum: CIB.JB3MUX 0
|
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||||||
enum: CIB.JB5MUX 0
|
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||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JC0MUX 0
|
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||||||
enum: CIB.JC2MUX 0
|
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||||||
enum: CIB.JC4MUX 0
|
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||||||
enum: CIB.JC6MUX 0
|
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||||||
enum: CIB.JD0MUX 0
|
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||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
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||||||
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.tile CIB_R70C44:VCIB_DCUB
|
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enum: CIB.JA1MUX 0
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||||||
enum: CIB.JA3MUX 0
|
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||||||
enum: CIB.JA5MUX 0
|
|
||||||
enum: CIB.JA7MUX 0
|
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||||||
enum: CIB.JB1MUX 0
|
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||||||
enum: CIB.JB3MUX 0
|
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||||||
enum: CIB.JB5MUX 0
|
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||||||
enum: CIB.JB7MUX 0
|
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||||||
enum: CIB.JC0MUX 0
|
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||||||
enum: CIB.JC2MUX 0
|
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||||||
enum: CIB.JC4MUX 0
|
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||||||
enum: CIB.JC6MUX 0
|
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||||||
enum: CIB.JD0MUX 0
|
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||||||
enum: CIB.JD2MUX 0
|
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||||||
enum: CIB.JD4MUX 0
|
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||||||
enum: CIB.JD6MUX 0
|
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.tile CIB_R70C45:VCIB_DCUC
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enum: CIB.JA1MUX 0
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enum: CIB.JA3MUX 0
|
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enum: CIB.JA5MUX 0
|
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||||||
enum: CIB.JA7MUX 0
|
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||||||
enum: CIB.JB1MUX 0
|
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||||||
enum: CIB.JB3MUX 0
|
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||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JC0MUX 0
|
|
||||||
enum: CIB.JC2MUX 0
|
|
||||||
enum: CIB.JC4MUX 0
|
|
||||||
enum: CIB.JC6MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
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||||||
enum: CIB.JD6MUX 0
|
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||||||
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.tile CIB_R70C46:VCIB_DCUD
|
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||||||
enum: CIB.JA1MUX 0
|
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||||||
enum: CIB.JA5MUX 0
|
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||||||
enum: CIB.JA7MUX 0
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JC0MUX 0
|
|
||||||
enum: CIB.JC2MUX 0
|
|
||||||
enum: CIB.JC4MUX 0
|
|
||||||
enum: CIB.JC6MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
|
||||||
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||||||
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||||||
.tile CIB_R70C47:VCIB_DCUF
|
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||||||
enum: CIB.JA1MUX 0
|
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||||||
enum: CIB.JA3MUX 0
|
|
||||||
enum: CIB.JA5MUX 0
|
|
||||||
enum: CIB.JA7MUX 0
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JC0MUX 0
|
|
||||||
enum: CIB.JC2MUX 0
|
|
||||||
enum: CIB.JC4MUX 0
|
|
||||||
enum: CIB.JC6MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
|
||||||
|
|
||||||
|
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||||||
.tile CIB_R70C48:VCIB_DCU3
|
|
||||||
enum: CIB.JA5MUX 0
|
|
||||||
enum: CIB.JA7MUX 0
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JC0MUX 0
|
|
||||||
enum: CIB.JC4MUX 0
|
|
||||||
enum: CIB.JC6MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
|
||||||
|
|
||||||
|
|
||||||
.tile CIB_R70C49:VCIB_DCU2
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
|
||||||
|
|
||||||
|
|
||||||
.tile CIB_R70C50:VCIB_DCUG
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
|
||||||
|
|
||||||
|
|
||||||
.tile CIB_R70C51:VCIB_DCUH
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
|
||||||
|
|
||||||
|
|
||||||
.tile CIB_R70C52:VCIB_DCUI
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
|
||||||
|
|
||||||
|
|
||||||
.tile CIB_R70C53:VCIB_DCU1
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
|
|
||||||
|
|
||||||
.tile CIB_R70C69:VCIB_DCU0
|
|
||||||
enum: CIB.JA1MUX 0
|
|
||||||
enum: CIB.JA3MUX 0
|
|
||||||
enum: CIB.JA5MUX 0
|
|
||||||
enum: CIB.JA7MUX 0
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
|
|
||||||
enum: CIB.JB7MUX 0
|
|
||||||
enum: CIB.JC0MUX 0
|
|
||||||
enum: CIB.JC2MUX 0
|
|
||||||
enum: CIB.JC4MUX 0
|
|
||||||
enum: CIB.JC6MUX 0
|
|
||||||
enum: CIB.JD0MUX 0
|
|
||||||
enum: CIB.JD2MUX 0
|
|
||||||
enum: CIB.JD4MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
|
||||||
|
|
||||||
|
|
||||||
.tile CIB_R70C6:CIB_EFB0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JC6MUX 0
|
|
||||||
enum: CIB.JD6MUX 0
|
|
||||||
|
|
||||||
|
|
||||||
.tile CIB_R70C70:VCIB_DCUA
|
|
||||||
enum: CIB.JA1MUX 0
|
|
||||||
enum: CIB.JA3MUX 0
|
|
||||||
enum: CIB.JA5MUX 0
|
|
||||||
enum: CIB.JA7MUX 0
|
|
||||||
enum: CIB.JB1MUX 0
|
|
||||||
enum: CIB.JB3MUX 0
|
|
||||||
enum: CIB.JB5MUX 0
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