caiyu/nextpnr
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55bd760808
nextpnr/himbaechel/uarch/ng-ultra/constids.inc
Miodrag Milanović 5a807110de
Adding NanoXplore NG-Ultra support (#1397) 
* ng-ultra: new architecture

* Implementation as in D2 deliverable

* Support for nxdesignsuite-24.0.0.0-20240429T102300

* Save memory by directly outputing json

* Add support for bidirectional IOs

* cleanup

* Create BFRs properly

* Add IOM insertion

* Cleanup

* Block certain pips depending of DDFR mode

* Add LUT bypass to improve routability

* Add bypass for CSC mode of GCK

* Fix IOM case

* Initial memory support

* Better RF/XRF handling

* fix

* RF placement and legalization

* Disconnect non available ports for NX_RAM

* cleanup

* Add RFB/RAM context support for latest release

* Remove ports that must not be used

* Proper port used only on RFB

* Add structure for clock sinks

* Use cell type where applicable

* Add clock sinks for other cell types

* Validation check fixes

* Commented too restrictive placement

* Added more crossbar wire type

* Hande IO termination input

* Fail early due to NX tools limitation for now

* Validations and fixes for RAM I/Os

* Fix for latest version of tools

* Use ctx->idf where applicable

* warn if RAM ports are not actually used

* Fix IOM packing

* Fix CY packing

* Change how constants are handled on CY

* Post placement optimization for CY

* Address comments for PR

* pack and export  GCK, WFG and PLL

* Cover more global routing cases

* Constraing to location if provided

* Place at LOC

* Pack and export DSP

* wip

* wip

* notes

* wip

* wip

* Validate DSPs

* DSP cascading

* Check mandatory parameters for DSP

* existing gck

* wip

* export all the rest for bitstream

* CDC packing

* add more sinks

* place FIFO

* map rest of FIFO ports

* enable pll by default

* cleanup

* Initial XLUT support

* Fix statistics

* Properly duplicate GCKs

* RRSTO and WRSTO are not used on XFIFO

* Fix for latest version of JSON format

* Implement GCK limitations

* cleanup

* cleanup

* Add more signals and use lowskew name

* cleanup code a bit

* Fix wfb

* detect cascaded GCKs

* Handle DFR

* Route dfr clock properly

* Cleanup

* Cleanup bitstream code

* Review issues addressed

* Move helper routines

* Expose private members for unit tests

* cleanup

* remove scale factor

* make all location helper arrays static

* Addressed review comments

* Support post-routing CSC and SCC

* Support NX_BFF

* Place CSS and SCC only on allowed locations

* Support latest Impulse

* ng_ultra: Expand bounding box further for left-edge IO

Signed-off-by: gatecat <gatecat@ds0.me>

* Export all IO parameters in bitstream

* Handle new CSV order or parameters and additional validation

* Add some more undocumented values for CSV

* Support for old and new CSV formats

* Initial DDFR support

* Display warning message once per file

* Address review issues

* Fix crash on memory access

* Make boundbox fit NG-Ultra internal design

* Update attributes after dff rewrite

* Implement basic NG-Ultra LUT-DFF unit tests

* Always use first seen xbar input

Signed-off-by: gatecat <gatecat@ds0.me>

* Simplified crossbar pip detection

* Change order to prevent issues with some unconnected constants

* Pack LUT and multiple DFF in stripe

* Place DFF chains

* Improve large DFF chains

* Rename to pack_dff_chains

* Better use XLUTs when possible

* pack output DFF together with XLUT

* option to disable XLUT optimiziations

* Make more optimizations optional

* fix to use pre-increment

* GCK for lowskew signals

* Bugfix for nets that are not part of lowskew network

* Fix bitstream export for PLL cell

* Remove separate route lowskew

* Allow WFG mode 2

* Merge inverter into GCK

* Add CSC per TILE when needed

* Improve reusage of existing cell for CSC

* Take preferred CSC

* Cleanup

* When in place CSC size not important

* Cleanup

* Reset and Load restriction

* make csc optimisation optional

* Proper count for IO resources

* Detect when there is no next cell for DSP chain

* Do not incorporate loops in XLUT

* Check if output exists

* Update copyright for delivery

* Make building NG-Ultra chip database optional, follow filename convention

* Ported drawing code to new API

* Update expandBoundingBox for NG-Ultra

* Copyright and license update

* Add README information

* cleanup and constids

* Using ctx->idf where applicable

* remove if_using_basecluster

* refactor extra data usage

* refactor to use create_cell_ptr only

* optimized getCSC

* optimize critical path a bit

* clangformat

* disable clangformat where applicable

---------

Signed-off-by: gatecat <gatecat@ds0.me>
Co-authored-by: Lofty <dan.ravensloft@gmail.com>
Co-authored-by: gatecat <gatecat@ds0.me>
2024-12-04 09:00:05 +01:00

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X(P25RR)
X(P26CI1)
X(P26CL)
X(P26CO)
X(P26CR)
X(P26CTI)
X(P26CTO)
X(P26EI1)
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X(P26RL)
X(P26RO1)
X(P26RO2)
X(P26RO3)
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X(P26RO5)
X(P26RO6)
X(P26RO7)
X(P26RO8)
X(P26RR)
X(P27CI1)
X(P27CL)
X(P27CO)
X(P27CR)
X(P27CTI)
X(P27CTO)
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X(P27EL)
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X(P27ER)
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X(P27RO6)
X(P27RO7)
X(P27RO8)
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X(P28EL)
X(P28EO)
X(P28ER)
X(P28RI)
X(P28RL)
X(P28RO1)
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X(P29CL)
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X(P31EI1)
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X(P31RO1)
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X(P32EL)
X(P32EO)
X(P32ER)
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X(P34EL)
X(P34EO)
X(P34ER)
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X(P34RR)
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X(P3EL)
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X(P6EL)
X(P6EO)
X(P6ER)
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X(P7EL)
X(P7EO)
X(P7ER)
X(P7RI)
X(P7RL)
X(P7RO1)
X(P7RO2)
X(P7RO3)
X(P7RO4)
X(P7RO5)
X(P7RO6)
X(P7RO7)
X(P7RO8)
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X(P8EI8)
X(P8EL)
X(P8EO)
X(P8ER)
X(P8RI)
X(P8RL)
X(P8RO1)
X(P8RO2)
X(P8RO3)
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X(P8RO8)
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X(P9EI8)
X(P9EL)
X(P9EO)
X(P9ER)
X(P9RI)
X(P9RL)
X(P9RO1)
X(P9RO2)
X(P9RO3)
X(P9RO4)
X(P9RO5)
X(P9RO6)
X(P9RO7)
X(P9RO8)
X(P9RR)
X(SE)
X(SWRX1CK)
X(SWRX2CK)
// IOP
X(IOP)
//X(C)
//X(I)
//X(O)
// IOTP
X(IOTP)
//X(C)
//X(I)
X(IO)
//X(O)
X(T)
// IP
X(IP)
//X(C)
//X(O)
// ITC
X(ITC)
//X(I)
//X(O)
// ITP
X(ITP)
//X(C)
//X(IO)
//X(O)
//X(T)
// ITS
X(ITS)
//X(I)
//X(O)
// LUT
X(LUT)
X(D)
//X(I1)
//X(I2)
//X(I3)
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// MSM
X(MSM)
//X(I1)
//X(I10)
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//X(I3)
//X(I30)
//X(I31)
//X(I32)
//X(I33)
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//X(I40)
//X(I41)
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//X(I5)
//X(I6)
//X(I7)
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//X(I9)
//X(O1)
//X(O10)
//X(O11)
//X(O12)
//X(O13)
//X(O14)
//X(O15)
//X(O16)
//X(O17)
//X(O18)
X(O19)
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X(O20)
X(O21)
X(O22)
X(O23)
X(O24)
X(O25)
X(O26)
X(O27)
X(O28)
X(O29)
//X(O3)
X(O30)
X(O31)
X(O32)
X(O33)
X(O34)
X(O35)
X(O36)
X(O37)
X(O38)
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X(O40)
X(O41)
X(O42)
X(O43)
X(O44)
X(O45)
X(O46)
X(O47)
X(O48)
//X(O5)
//X(O6)
//X(O7)
//X(O8)
//X(O9)
// OP
X(OP)
//X(C)
//X(I)
// OTC
X(OTC)
//X(I)
//X(O)
// OTP
X(OTP)
//X(C)
//X(I)
//X(IO)
//X(T)
// OTS
X(OTS)
//X(I)
//X(O)
// PLL
X(PLL)
X(ARST_CAL)
X(CAL1)
X(CAL2)
X(CAL3)
X(CAL4)
X(CAL5)
X(CAL_LOCKED)
X(CLK_CAL)
X(CLK_CAL_DIV)
X(CLK_DIV1)
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X(EXT_CAL1)
X(EXT_CAL2)
X(EXT_CAL3)
X(EXT_CAL4)
X(EXT_CAL5)
X(EXT_CAL_LOCKED)
X(FBK)
X(LDFO)
X(OSC)
X(PLL_LOCKED)
X(PLL_LOCKEDA)
//X(R)
X(REF)
X(REFO)
X(VCO)
X(scan_en_i)
X(scan_in_i1)
X(scan_in_i10)
X(scan_in_i11)
X(scan_in_i12)
X(scan_in_i13)
X(scan_in_i14)
X(scan_in_i15)
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X(scan_in_i2)
X(scan_in_i20)
X(scan_in_i21)
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X(scan_in_i27)
X(scan_in_i28)
X(scan_in_i29)
X(scan_in_i3)
X(scan_in_i30)
X(scan_in_i31)
X(scan_in_i32)
X(scan_in_i33)
X(scan_in_i34)
X(scan_in_i35)
X(scan_in_i36)
X(scan_in_i37)
X(scan_in_i4)
X(scan_in_i5)
X(scan_in_i6)
X(scan_in_i7)
X(scan_in_i8)
X(scan_in_i9)
X(scan_out_o1)
X(scan_out_o10)
X(scan_out_o11)
X(scan_out_o12)
X(scan_out_o13)
X(scan_out_o14)
X(scan_out_o15)
X(scan_out_o16)
X(scan_out_o17)
X(scan_out_o18)
X(scan_out_o19)
X(scan_out_o2)
X(scan_out_o20)
X(scan_out_o21)
X(scan_out_o22)
X(scan_out_o23)
X(scan_out_o24)
X(scan_out_o25)
X(scan_out_o26)
X(scan_out_o27)
X(scan_out_o28)
X(scan_out_o29)
X(scan_out_o3)
X(scan_out_o30)
X(scan_out_o31)
X(scan_out_o32)
X(scan_out_o33)
X(scan_out_o34)
X(scan_out_o35)
X(scan_out_o36)
X(scan_out_o37)
X(scan_out_o4)
X(scan_out_o5)
X(scan_out_o6)
X(scan_out_o7)
X(scan_out_o8)
X(scan_out_o9)
// PMA
X(PMA)
X(CAL_OUT_O)
//X(CLK_O)
X(CLK_RX_O)
X(DBG_A_I)
X(DBG_R_O)
//X(DBG_S_I1)
//X(DBG_S_I2)
X(DC_ADD_I1)
X(DC_ADD_I2)
X(DC_ADD_I3)
X(DC_ADD_I4)
X(DC_CCSN_I)
X(DC_E_I)
X(DC_LCSN_I1)
X(DC_LCSN_I2)
X(DC_LCSN_I3)
X(DC_LCSN_I4)
X(DC_WDATAS_I)
X(DC_WDATA_I1)
X(DC_WDATA_I10)
X(DC_WDATA_I11)
X(DC_WDATA_I12)
X(DC_WDATA_I2)
X(DC_WDATA_I3)
X(DC_WDATA_I4)
X(DC_WDATA_I5)
X(DC_WDATA_I6)
X(DC_WDATA_I7)
X(DC_WDATA_I8)
X(DC_WDATA_I9)
X(DC_WE_N_I)
X(FB_LOCK_O)
X(LINK_RX0)
X(LINK_RX1)
X(LINK_RX2)
X(LINK_RX3)
X(LINK_TX0)
X(LINK_TX1)
X(LINK_TX2)
X(LINK_TX3)
X(LL_O1)
X(LL_O10)
X(LL_O11)
X(LL_O12)
X(LL_O13)
X(LL_O14)
X(LL_O15)
X(LL_O16)
X(LL_O17)
X(LL_O18)
X(LL_O19)
X(LL_O2)
X(LL_O20)
X(LL_O3)
X(LL_O4)
X(LL_O5)
X(LL_O6)
X(LL_O7)
X(LL_O8)
X(LL_O9)
X(LOCKA_O)
X(LOCK_O)
X(PLL_RN_I)
//X(PWDN_N_I)
//X(RST_N_I)
X(SCAN_I1)
X(SCAN_I2)
X(SCAN_I3)
X(SCAN_I4)
X(SCAN_I5)
X(SCAN_I6)
X(SCAN_I7)
X(SCAN_I8)
X(SCAN_O1)
X(SCAN_O2)
X(SCAN_O3)
X(SCAN_O4)
X(SCAN_O5)
X(SCAN_O6)
X(SCAN_O7)
X(SCAN_O8)
X(SE_I)
X(calibrate)
X(ckrefn)
X(ckrefp)
X(hssl_clock_i1)
X(hssl_clock_i2)
X(hssl_clock_i3)
X(hssl_clock_i4)
X(pll_ckref_in)
X(pll_ckref_out)
X(pma_pll_fbr_clk_ref_o)
X(rx0n)
X(rx0p)
X(rx1n)
X(rx1p)
X(rx2n)
X(rx2p)
X(rx3n)
X(rx3p)
X(tx0n)
X(tx0p)
X(tx1n)
X(tx1p)
X(tx2n)
X(tx2p)
X(tx3n)
X(tx3p)
// RAM
X(RAM)
X(AA1)
X(AA10)
X(AA11)
X(AA12)
X(AA13)
X(AA14)
X(AA15)
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X(AA2)
X(AA3)
X(AA4)
X(AA5)
X(AA6)
X(AA7)
X(AA8)
X(AA9)
X(ACK)
X(ACKC)
X(ACKD)
X(ACKR)
X(ACOR)
X(ACS)
X(AERR)
//X(AI1)
X(AI10)
X(AI11)
X(AI12)
X(AI13)
X(AI14)
X(AI15)
X(AI16)
X(AI17)
X(AI18)
X(AI19)
//X(AI2)
X(AI20)
X(AI21)
X(AI22)
X(AI23)
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//X(AI3)
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X(WRSTI3)
X(WRSTI4)
//X(WRSTO)
// XHFIFO
X(XHFIFO)
//X(I1)
//X(I10)
//X(I11)
//X(I12)
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//X(I2)
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//X(I4)
//X(I5)
//X(I6)
//X(I7)
//X(I8)
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//X(O10)
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//X(O7)
//X(O8)
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//X(RAI3)
//X(RAI4)
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X(XHRF)
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//X(I2)
//X(I3)
//X(I4)
//X(I5)
//X(I6)
//X(I7)
//X(I8)
//X(I9)
//X(O1)
//X(O10)
//X(O11)
//X(O12)
//X(O13)
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//X(O2)
//X(O3)
//X(O4)
//X(O5)
//X(O6)
//X(O7)
//X(O8)
//X(O9)
//X(RA1)
//X(RA2)
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X(RA6)
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X(WA6)
//X(WCK1)
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//X(WE)
//X(WEA)
// XLUT
X(XLUT)
X(G1)
X(G2)
X(G3)
X(G4)
//X(I1)
//X(I2)
//X(I3)
//X(I4)
//X(J)
//X(O)
// XPRF
X(XPRF)
//X(I1)
//X(I10)
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//X(I3)
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X(RA7)
X(RA8)
X(RA9)
//X(WA1)
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X(XRF)
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X(XWFIFO)
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//X(I36)
//X(I4)
//X(I5)
//X(I6)
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//X(I8)
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//X(O10)
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//X(O4)
//X(O5)
//X(O6)
//X(O7)
//X(O8)
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//X(RAI1)
//X(RAI2)
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//X(RAI6)
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//X(REQ)
//X(RRSTI1)
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//X(WAI1)
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//X(WEA)
//X(WEQ)
//X(WRSTI1)
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// XWRF
X(XWRF)
//X(I1)
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//X(O10)
//X(O11)
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//X(O4)
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//X(RA1)
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//X(WA1)
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//X(WA4)
//X(WA5)
//X(WCK1)
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//X(WE)
//X(WEA)
// end of autogenerated items
// start of generated parameter list
// NX_BD
X(NX_BD)
X(mode)
// NX_BFF
X(NX_BFF)
// NX_BFR
X(NX_BFR)
X(data_inv)
X(iobname)
X(location)
//X(mode)
X(path)
X(ring)
// NX_CDC_L
X(NX_CDC_L)
X(ack_sel)
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X(cck_sel)
X(ck0_edge)
X(ck1_edge)
X(dck_sel)
X(gt0_bypass_reg1)
X(gt0_bypass_reg2)
X(gt1_bypass_reg1)
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X(link_BA)
X(link_CB)
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//X(mode)
X(use_adest_arst)
X(use_asrc_arst)
X(use_bdest_arst)
X(use_bsrc_arst)
X(use_cdest_arst)
X(use_csrc_arst)
X(use_ddest_arst)
X(use_dsrc_arst)
// NX_CDC_L_2DFF
X(NX_CDC_L_2DFF)
//X(ack_sel)
//X(bck_sel)
//X(ck0_edge)
//X(ck1_edge)
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//X(use_adest_arst)
//X(use_bdest_arst)
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//X(ack_sel)
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//X(gt1_bypass_reg2)
//X(use_adest_arst)
//X(use_asrc_arst)
//X(use_bdest_arst)
//X(use_bsrc_arst)
// NX_CDC_L_BIN2GRAY
X(NX_CDC_L_BIN2GRAY)
// NX_CDC_L_FULL
X(NX_CDC_L_FULL)
//X(ack_sel)
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//X(ck0_edge)
//X(ck1_edge)
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//X(use_adest_arst)
//X(use_asrc_arst)
//X(use_bdest_arst)
//X(use_bsrc_arst)
// NX_CDC_U
X(NX_CDC_U)
//X(ack_sel)
//X(bck_sel)
//X(cck_sel)
//X(ck0_edge)
//X(ck1_edge)
//X(dck_sel)
//X(link_BA)
//X(link_CB)
//X(link_DC)
//X(mode)
//X(use_adest_arst)
//X(use_asrc_arst)
//X(use_bdest_arst)
//X(use_bsrc_arst)
//X(use_cdest_arst)
//X(use_csrc_arst)
//X(use_ddest_arst)
//X(use_dsrc_arst)
// NX_CDC_U_2DFF
X(NX_CDC_U_2DFF)
//X(ack_sel)
//X(bck_sel)
//X(ck0_edge)
//X(ck1_edge)
//X(use_adest_arst)
//X(use_bdest_arst)
// NX_CDC_U_3DFF
X(NX_CDC_U_3DFF)
//X(ack_sel)
//X(bck_sel)
//X(ck0_edge)
//X(ck1_edge)
//X(use_adest_arst)
//X(use_asrc_arst)
//X(use_bdest_arst)
//X(use_bsrc_arst)
// NX_CDC_U_BIN2GRAY
X(NX_CDC_U_BIN2GRAY)
// NX_CDC_U_FULL
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//X(ack_sel)
//X(bck_sel)
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//X(ck1_edge)
//X(use_adest_arst)
//X(use_asrc_arst)
//X(use_bdest_arst)
//X(use_bsrc_arst)
// NX_CDC_U_GRAY2BIN
X(NX_CDC_U_GRAY2BIN)
// NX_CKS
X(NX_CKS)
X(ck_edge)
// NX_CKS_U
X(NX_CKS_U)
// NX_CMUX_U
X(NX_CMUX_U)
// NX_CRX_L
X(NX_CRX_L)
//X(location)
X(pcs_8b_dscr_sel)
X(pcs_align_bypass)
X(pcs_buffers_bypass)
X(pcs_buffers_use_cdc)
X(pcs_bypass_pma_cdc)
X(pcs_bypass_usr_cdc)
X(pcs_comma_mask)
X(pcs_debug_en)
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X(pcs_el_buff_diff_bef_comp)
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X(pcs_el_buff_skp_char_2)
X(pcs_el_buff_skp_char_3)
X(pcs_el_buff_skp_header_0)
X(pcs_el_buff_skp_header_1)
X(pcs_el_buff_skp_header_2)
X(pcs_el_buff_skp_header_3)
X(pcs_el_buff_skp_header_size)
X(pcs_el_buff_skp_seq_size)
X(pcs_el_buff_underflow_handle)
X(pcs_fsm_sel)
X(pcs_fsm_watchdog_en)
X(pcs_loopback)
X(pcs_m_comma_en)
X(pcs_m_comma_val)
X(pcs_nb_comma_bef_realign)
X(pcs_p_comma_en)
X(pcs_p_comma_val)
X(pcs_polarity)
X(pcs_protocol_size)
X(pcs_replace_bypass)
X(pcs_sync_supported)
X(pma_cdr_cp)
X(pma_clk_pos)
X(pma_ctrl_term)
X(pma_loopback)
X(pma_pll_cpump_n)
X(pma_pll_divf)
X(pma_pll_divf_en_n)
X(pma_pll_divm)
X(pma_pll_divm_en_n)
X(pma_pll_divn)
X(pma_pll_divn_en_n)
X(test)
// NX_CRX_U
X(NX_CRX_U)
X(gearbox_en)
X(gearbox_mode)
//X(location)
//X(pcs_8b_dscr_sel)
//X(pcs_align_bypass)
//X(pcs_buffers_bypass)
//X(pcs_buffers_use_cdc)
//X(pcs_bypass_pma_cdc)
//X(pcs_bypass_usr_cdc)
//X(pcs_comma_mask)
//X(pcs_debug_en)
//X(pcs_dec_bypass)
//X(pcs_dscr_bypass)
//X(pcs_el_buff_diff_bef_comp)
//X(pcs_el_buff_max_comp)
//X(pcs_el_buff_only_one_skp)
//X(pcs_el_buff_skp_char_0)
//X(pcs_el_buff_skp_char_1)
//X(pcs_el_buff_skp_char_2)
//X(pcs_el_buff_skp_char_3)
//X(pcs_el_buff_skp_header_0)
//X(pcs_el_buff_skp_header_1)
//X(pcs_el_buff_skp_header_2)
//X(pcs_el_buff_skp_header_3)
//X(pcs_el_buff_skp_header_size)
//X(pcs_el_buff_skp_seq_size)
//X(pcs_fsm_sel)
//X(pcs_fsm_watchdog_en)
//X(pcs_loopback)
//X(pcs_m_comma_en)
//X(pcs_m_comma_val)
//X(pcs_nb_comma_bef_realign)
//X(pcs_p_comma_en)
//X(pcs_p_comma_val)
//X(pcs_polarity)
//X(pcs_protocol_size)
//X(pcs_replace_bypass)
//X(pcs_sync_supported)
//X(pma_cdr_cp)
//X(pma_clk_pos)
X(pma_coarse_ppm)
//X(pma_ctrl_term)
X(pma_dco_divl)
X(pma_dco_divm)
X(pma_dco_divn)
X(pma_dco_reg_res)
X(pma_dco_vref_sel)
X(pma_fine_ppm)
//X(pma_loopback)
X(pma_m_eye_ppm)
X(pma_peak_detect_cmd)
X(pma_peak_detect_on)
//X(pma_pll_cpump_n)
//X(pma_pll_divf)
//X(pma_pll_divf_en_n)
//X(pma_pll_divm)
//X(pma_pll_divm_en_n)
//X(pma_pll_divn)
//X(pma_pll_divn_en_n)
// NX_CTX_L
X(NX_CTX_L)
//X(location)
X(pcs_8b_scr_sel)
//X(pcs_bypass_pma_cdc)
//X(pcs_bypass_usr_cdc)
X(pcs_enc_bypass)
X(pcs_esistream_fsm_en)
//X(pcs_loopback)
//X(pcs_polarity)
//X(pcs_protocol_size)
//X(pcs_replace_bypass)
X(pcs_scr_bypass)
X(pcs_scr_init)
//X(pcs_sync_supported)
//X(pma_clk_pos)
//X(pma_loopback)
//X(test)
// NX_CTX_U
X(NX_CTX_U)
//X(gearbox_en)
//X(gearbox_mode)
//X(location)
//X(pcs_8b_scr_sel)
//X(pcs_bypass_pma_cdc)
//X(pcs_bypass_usr_cdc)
//X(pcs_enc_bypass)
//X(pcs_esistream_fsm_en)
//X(pcs_loopback)
//X(pcs_polarity)
//X(pcs_protocol_size)
//X(pcs_replace_bypass)
//X(pcs_scr_bypass)
//X(pcs_scr_init)
//X(pcs_sync_supported)
//X(pma_clk_pos)
//X(pma_loopback)
// NX_CY
X(NX_CY)
X(add_carry)
X(shifter)
// NX_DES
X(NX_DES)
X(data_size)
X(differential)
X(dpath_dynamic)
X(drive)
X(inputDelayLine)
X(inputSignalSlope)
//X(location)
X(locked)
X(standard)
X(termination)
X(terminationReference)
X(turbo)
X(weakTermination)
// NX_DFF
X(NX_DFF)
X(dff_ctxt)
X(dff_edge)
X(dff_init)
X(dff_load)
X(dff_sync)
X(dff_type)
// NX_DFR
X(NX_DFR)
//X(data_inv)
//X(dff_edge)
//X(dff_init)
//X(dff_load)
//X(dff_sync)
//X(dff_type)
//X(iobname)
//X(location)
//X(mode)
//X(path)
//X(ring)
// NX_DDFR_U
X(NX_DDFR_U)
// NX_DSP
X(NX_DSP)
X(raw_config0)
X(raw_config1)
X(raw_config2)
X(raw_config3)
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X(NX_DSP_L)
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X(cfg_rx3_pcs_el_buff_only_one_skp_i)
X(cfg_rx3_pcs_el_buff_skp_char_0_i)
X(cfg_rx3_pcs_el_buff_skp_char_1_i)
X(cfg_rx3_pcs_el_buff_skp_char_2_i)
X(cfg_rx3_pcs_el_buff_skp_char_3_i)
X(cfg_rx3_pcs_el_buff_skp_header_0_i)
X(cfg_rx3_pcs_el_buff_skp_header_1_i)
X(cfg_rx3_pcs_el_buff_skp_header_2_i)
X(cfg_rx3_pcs_el_buff_skp_header_3_i)
X(cfg_rx3_pcs_el_buff_skp_header_size_i)
X(cfg_rx3_pcs_el_buff_skp_seq_size_i)
X(cfg_rx3_pcs_fsm_sel_i)
X(cfg_rx3_pcs_fsm_watchdog_en_i)
X(cfg_rx3_pcs_loopback_i)
X(cfg_rx3_pcs_m_comma_en_i)
X(cfg_rx3_pcs_m_comma_val_i)
X(cfg_rx3_pcs_nb_comma_bef_realign_i)
X(cfg_rx3_pcs_p_comma_en_i)
X(cfg_rx3_pcs_p_comma_val_i)
X(cfg_rx3_pcs_polarity_i)
X(cfg_rx3_pcs_protocol_size_i)
X(cfg_rx3_pcs_replace_bypass_i)
X(cfg_rx3_pcs_sync_supported_i)
X(cfg_rx3_pma_cdr_cp_i)
X(cfg_rx3_pma_clk_pos_i)
X(cfg_rx3_pma_coarse_ppm_i)
X(cfg_rx3_pma_ctrl_term_i)
X(cfg_rx3_pma_dco_divl_i)
X(cfg_rx3_pma_dco_divm_i)
X(cfg_rx3_pma_dco_divn_i)
X(cfg_rx3_pma_dco_reg_res_i)
X(cfg_rx3_pma_dco_vref_sel_i)
X(cfg_rx3_pma_fine_ppm_i)
X(cfg_rx3_pma_loopback_i)
X(cfg_rx3_pma_m_eye_ppm_i)
X(cfg_rx3_pma_peak_detect_cmd_i)
X(cfg_rx3_pma_peak_detect_on_i)
X(cfg_rx3_pma_pll_cpump_n_i)
X(cfg_rx3_pma_pll_divf_en_n_i)
X(cfg_rx3_pma_pll_divf_i)
X(cfg_rx3_pma_pll_divm_en_n_i)
X(cfg_rx3_pma_pll_divm_i)
X(cfg_rx3_pma_pll_divn_en_n_i)
X(cfg_rx3_pma_pll_divn_i)
X(cfg_test_mode_i)
X(cfg_tx0_gearbox_en_i)
X(cfg_tx0_gearbox_mode_i)
X(cfg_tx0_pcs_8b_scr_sel_i)
X(cfg_tx0_pcs_bypass_pma_cdc_i)
X(cfg_tx0_pcs_bypass_usr_cdc_i)
X(cfg_tx0_pcs_enc_bypass_i)
X(cfg_tx0_pcs_esistream_fsm_en_i)
X(cfg_tx0_pcs_loopback_i)
X(cfg_tx0_pcs_polarity_i)
X(cfg_tx0_pcs_protocol_size_i)
X(cfg_tx0_pcs_replace_bypass_i)
X(cfg_tx0_pcs_scr_bypass_i)
X(cfg_tx0_pcs_scr_init_i)
X(cfg_tx0_pcs_sync_supported_i)
X(cfg_tx0_pma_clk_pos_i)
X(cfg_tx0_pma_loopback_i)
X(cfg_tx1_gearbox_en_i)
X(cfg_tx1_gearbox_mode_i)
X(cfg_tx1_pcs_8b_scr_sel_i)
X(cfg_tx1_pcs_bypass_pma_cdc_i)
X(cfg_tx1_pcs_bypass_usr_cdc_i)
X(cfg_tx1_pcs_enc_bypass_i)
X(cfg_tx1_pcs_esistream_fsm_en_i)
X(cfg_tx1_pcs_loopback_i)
X(cfg_tx1_pcs_polarity_i)
X(cfg_tx1_pcs_protocol_size_i)
X(cfg_tx1_pcs_replace_bypass_i)
X(cfg_tx1_pcs_scr_bypass_i)
X(cfg_tx1_pcs_scr_init_i)
X(cfg_tx1_pcs_sync_supported_i)
X(cfg_tx1_pma_clk_pos_i)
X(cfg_tx1_pma_loopback_i)
X(cfg_tx2_gearbox_en_i)
X(cfg_tx2_gearbox_mode_i)
X(cfg_tx2_pcs_8b_scr_sel_i)
X(cfg_tx2_pcs_bypass_pma_cdc_i)
X(cfg_tx2_pcs_bypass_usr_cdc_i)
X(cfg_tx2_pcs_enc_bypass_i)
X(cfg_tx2_pcs_esistream_fsm_en_i)
X(cfg_tx2_pcs_loopback_i)
X(cfg_tx2_pcs_polarity_i)
X(cfg_tx2_pcs_protocol_size_i)
X(cfg_tx2_pcs_replace_bypass_i)
X(cfg_tx2_pcs_scr_bypass_i)
X(cfg_tx2_pcs_scr_init_i)
X(cfg_tx2_pcs_sync_supported_i)
X(cfg_tx2_pma_clk_pos_i)
X(cfg_tx2_pma_loopback_i)
X(cfg_tx3_gearbox_en_i)
X(cfg_tx3_gearbox_mode_i)
X(cfg_tx3_pcs_8b_scr_sel_i)
X(cfg_tx3_pcs_bypass_pma_cdc_i)
X(cfg_tx3_pcs_bypass_usr_cdc_i)
X(cfg_tx3_pcs_enc_bypass_i)
X(cfg_tx3_pcs_esistream_fsm_en_i)
X(cfg_tx3_pcs_loopback_i)
X(cfg_tx3_pcs_polarity_i)
X(cfg_tx3_pcs_protocol_size_i)
X(cfg_tx3_pcs_replace_bypass_i)
X(cfg_tx3_pcs_scr_bypass_i)
X(cfg_tx3_pcs_scr_init_i)
X(cfg_tx3_pcs_sync_supported_i)
X(cfg_tx3_pma_clk_pos_i)
X(cfg_tx3_pma_loopback_i)
//X(location)
X(rx_usrclk_use_pcs_clk_2)
X(tx_usrclk_use_pcs_clk_2)
// NX_IOB
X(NX_IOB)
//X(differential)
//X(drive)
X(dynDrive)
X(dynInput)
X(dynTerm)
X(extra)
//X(inputDelayLine)
X(inputDelayOn)
//X(inputSignalSlope)
//X(location)
//X(locked)
X(outputCapacity)
X(outputDelayLine)
X(outputDelayOn)
X(slewRate)
//X(standard)
//X(termination)
//X(terminationReference)
//X(turbo)
//X(weakTermination)
// NX_IOB_I
X(NX_IOB_I)
//X(differential)
//X(drive)
//X(dynDrive)
//X(dynInput)
//X(dynTerm)
//X(extra)
//X(inputDelayLine)
//X(inputDelayOn)
//X(inputSignalSlope)
//X(location)
//X(locked)
//X(outputCapacity)
//X(outputDelayLine)
//X(outputDelayOn)
//X(slewRate)
//X(standard)
//X(termination)
//X(terminationReference)
//X(turbo)
//X(weakTermination)
// NX_IOB_O
X(NX_IOB_O)
//X(differential)
//X(drive)
//X(dynDrive)
//X(dynInput)
//X(dynTerm)
//X(extra)
//X(inputDelayLine)
//X(inputDelayOn)
//X(inputSignalSlope)
//X(location)
//X(locked)
//X(outputCapacity)
//X(outputDelayLine)
//X(outputDelayOn)
//X(slewRate)
//X(standard)
//X(termination)
//X(terminationReference)
//X(turbo)
//X(weakTermination)
// NX_IOM
X(NX_IOM)
X(div_rx1)
X(div_rx2)
X(div_tx1)
X(div_tx2)
X(mode_io_cal)
X(mode_side1)
X(mode_side2)
X(pads_dict)
X(pads_path)
X(sel_clk_out1)
X(sel_clk_out2)
X(sel_clkr_rx1)
X(sel_clkr_rx2)
X(sel_clkw_rx1)
X(sel_clkw_rx2)
// NX_IOM_BIN2GRP
X(NX_IOM_BIN2GRP)
// NX_IOM_CONTROL
X(NX_IOM_CONTROL)
//X(div_rx1)
//X(div_rx2)
//X(div_tx1)
//X(div_tx2)
X(inv_di_fclk1)
X(inv_di_fclk2)
X(latency1)
X(latency2)
//X(location)
X(mode_cpath)
X(mode_epath)
//X(mode_io_cal)
X(mode_rpath)
//X(mode_side1)
//X(mode_side2)
X(mode_tpath)
//X(sel_clk_out1)
//X(sel_clk_out2)
//X(sel_clkr_rx1)
//X(sel_clkr_rx2)
//X(sel_clkw_rx1)
//X(sel_clkw_rx2)
// NX_IOM_CONTROL_L
X(NX_IOM_CONTROL_L)
//X(div_rx1)
//X(div_rx2)
//X(div_tx1)
//X(div_tx2)
//X(inv_di_fclk1)
//X(inv_di_fclk2)
//X(latency1)
//X(latency2)
//X(location)
//X(mode_cpath)
//X(mode_epath)
//X(mode_io_cal)
//X(mode_rpath)
//X(mode_side1)
//X(mode_side2)
//X(mode_tpath)
//X(sel_clk_out1)
//X(sel_clk_out2)
//X(sel_clkr_rx1)
//X(sel_clkr_rx2)
//X(sel_clkw_rx1)
//X(sel_clkw_rx2)
// NX_IOM_CONTROL_M
X(NX_IOM_CONTROL_M)
//X(div_rx1)
//X(div_rx2)
//X(div_tx1)
//X(div_tx2)
//X(inv_di_fclk1)
//X(inv_di_fclk2)
//X(latency1)
//X(latency2)
//X(location)
//X(mode_cpath)
//X(mode_epath)
//X(mode_io_cal)
//X(mode_rpath)
//X(mode_side1)
//X(mode_side2)
//X(mode_tpath)
//X(sel_clk_out1)
//X(sel_clk_out2)
//X(sel_clkr_rx1)
//X(sel_clkr_rx2)
//X(sel_clkw_rx1)
//X(sel_clkw_rx2)
// NX_IOM_CONTROL_U
X(NX_IOM_CONTROL_U)
X(cal_delay1)
X(cal_delay2)
X(div1)
X(div2)
X(div3)
X(div_swrx1)
X(div_swrx2)
X(inv_ld_sck1)
X(inv_ld_sck2)
X(inv_ld_sck3)
X(link_ld_12)
X(link_ld_23)
//X(location)
//X(mode_side1)
//X(mode_side2)
X(mode_side3)
//X(sel_clk_out1)
//X(sel_clk_out2)
X(sel_dc_clk)
X(sel_ld_fck1)
X(sel_ld_fck2)
X(sel_ld_fck3)
X(sel_sw_fck1)
X(sel_sw_fck2)
X(use_dc)
// NX_IOM_DRIVER
X(NX_IOM_DRIVER)
X(chained)
X(cpath_edge)
X(cpath_init)
X(cpath_inv)
X(cpath_load)
X(cpath_mode)
X(cpath_sync)
X(epath_dynamic)
X(epath_edge)
X(epath_init)
X(epath_load)
X(epath_mode)
X(epath_sync)
//X(location)
X(rpath_dynamic)
X(rpath_edge)
X(rpath_init)
X(rpath_load)
X(rpath_mode)
X(rpath_sync)
X(symbol)
X(tpath_mode)
X(variant)
// NX_IOM_DRIVER_M
X(NX_IOM_DRIVER_M)
//X(chained)
//X(cpath_edge)
//X(cpath_init)
//X(cpath_inv)
//X(cpath_load)
//X(cpath_mode)
//X(cpath_sync)
//X(epath_dynamic)
//X(epath_edge)
//X(epath_init)
//X(epath_load)
//X(epath_mode)
//X(epath_sync)
//X(location)
//X(rpath_dynamic)
//X(rpath_edge)
//X(rpath_init)
//X(rpath_load)
//X(rpath_mode)
//X(rpath_sync)
//X(symbol)
//X(tpath_mode)
//X(variant)
// NX_IOM_DRIVER_U
X(NX_IOM_DRIVER_U)
//X(chained)
//X(cpath_edge)
//X(cpath_init)
//X(cpath_inv)
//X(cpath_load)
//X(cpath_mode)
//X(cpath_sync)
X(cpath_type)
//X(epath_dynamic)
//X(epath_edge)
//X(epath_init)
//X(epath_load)
//X(epath_mode)
//X(epath_sync)
X(epath_type)
//X(location)
//X(rpath_dynamic)
//X(rpath_edge)
//X(rpath_init)
//X(rpath_load)
//X(rpath_mode)
//X(rpath_sync)
X(rpath_type)
//X(symbol)
//X(tpath_mode)
// NX_IOM_L
X(NX_IOM_L)
//X(div_rx1)
//X(div_rx2)
//X(div_tx1)
//X(div_tx2)
//X(mode_io_cal)
//X(mode_side1)
//X(mode_side2)
//X(pads_dict)
//X(pads_path)
//X(sel_clk_out1)
//X(sel_clk_out2)
//X(sel_clkr_rx1)
//X(sel_clkr_rx2)
//X(sel_clkw_rx1)
//X(sel_clkw_rx2)
// NX_IOM_SERDES
X(NX_IOM_SERDES)
//X(data_size)
//X(location)
// NX_IOM_SERDES_M
X(NX_IOM_SERDES_M)
//X(data_size)
//X(location)
// NX_IOM_SERDES_U
X(NX_IOM_SERDES_U)
//X(data_size)
//X(location)
// NX_IOM_U
X(NX_IOM_U)
//X(cal_delay1)
//X(cal_delay2)
//X(div1)
//X(div2)
//X(div3)
//X(div_swrx1)
//X(div_swrx2)
//X(inv_ld_sck1)
//X(inv_ld_sck2)
//X(inv_ld_sck3)
//X(link_ld_12)
//X(link_ld_23)
//X(mode_side1)
//X(mode_side2)
//X(mode_side3)
//X(pads_dict)
//X(pads_path)
//X(sel_clk_out1)
//X(sel_clk_out2)
//X(sel_dc_clk)
//X(sel_ld_fck1)
//X(sel_ld_fck2)
//X(sel_ld_fck3)
//X(sel_sw_fck1)
//X(sel_sw_fck2)
//X(use_dc)
// NX_LUT
X(NX_LUT)
X(lut_table)
// NX_PLL
X(NX_PLL)
X(clk_outdiv1)
X(clk_outdiv2)
X(clk_outdiv3)
X(ext_fbk_on)
X(fbk_delay)
X(fbk_delay_on)
X(fbk_div_on)
X(fbk_intdiv)
//X(location)
X(ref_div_on)
X(vco_range)
// NX_PLL_L
X(NX_PLL_L)
X(cfg_use_pll)
X(clk_outdivo1)
X(clk_outdivp1)
X(clk_outdivp2)
X(clk_outdivp3o2)
//X(ext_fbk_on)
//X(fbk_delay)
//X(fbk_delay_on)
//X(fbk_intdiv)
//X(location)
X(pll_cpump)
X(ref_intdiv)
X(ref_osc_on)
X(wfg_sync_cal_lock)
X(wfg_sync_pll_lock)
// NX_PLL_U
X(NX_PLL_U)
X(cal_delay)
X(cal_div)
X(clk_cal_sel)
//X(clk_outdiv1)
//X(clk_outdiv2)
//X(clk_outdiv3)
X(clk_outdiv4)
X(clk_outdivd1)
X(clk_outdivd2)
X(clk_outdivd3)
X(clk_outdivd4)
X(clk_outdivd5)
//X(ext_fbk_on)
//X(fbk_delay)
//X(fbk_delay_on)
//X(fbk_intdiv)
//X(location)
//X(pll_cpump)
X(pll_lock)
X(pll_lpf_cap)
X(pll_lpf_res)
X(pll_odf)
//X(ref_intdiv)
//X(ref_osc_on)
X(use_cal)
X(use_pll)
// NX_PLL_U_WRAP
X(NX_PLL_U_WRAP)
//X(cal_delay)
//X(cal_div)
//X(clk_cal_sel)
//X(clk_outdiv1)
//X(clk_outdiv2)
//X(clk_outdiv3)
//X(clk_outdiv4)
//X(clk_outdivd1)
//X(clk_outdivd2)
//X(clk_outdivd3)
//X(clk_outdivd4)
//X(clk_outdivd5)
//X(ext_fbk_on)
//X(fbk_delay)
//X(fbk_delay_on)
//X(fbk_intdiv)
//X(location)
//X(pll_cpump)
//X(pll_lock)
//X(pll_lpf_cap)
//X(pll_lpf_res)
//X(pll_odf)
//X(ref_intdiv)
//X(ref_osc_on)
//X(use_cal)
//X(use_pll)
// NX_PMA_L
X(NX_PMA_L)
//X(location)
X(main_clk_to_fabric_div_en)
X(main_clk_to_fabric_div_mode)
X(main_clk_to_fabric_sel)
X(main_test)
X(main_use_only_usr_clock)
X(main_use_pcs_clk_2)
X(pcs_ovs_mode)
X(pcs_pll_lock_count)
X(pcs_word_len)
X(pll_pma_cpump_n)
X(pll_pma_divf)
X(pll_pma_divf_en_n)
X(pll_pma_divm)
X(pll_pma_divm_en_n)
X(pll_pma_divn)
X(pll_pma_divn_en_n)
X(pll_pma_int_data_len)
X(pll_pma_lvds_mux)
X(pll_pma_mux_ckref)
X(rx_pma_half_step)
// NX_PMA_U
X(NX_PMA_U)
X(dyn_all_rx_pma_m_eye)
X(dyn_all_rx_pma_m_eye_coarse_ena)
X(dyn_all_rx_pma_m_eye_dn)
X(dyn_all_rx_pma_m_eye_fine_ena)
X(dyn_all_rx_pma_m_eye_step)
X(dyn_all_rx_pma_m_eye_up)
X(dyn_all_rx_pma_threshold_1)
X(dyn_all_rx_pma_threshold_2)
X(dyn_all_rx_pma_trim_locked)
X(dyn_all_rx_pma_trim_mode)
X(dyn_all_rx_pma_trim_unlocked)
X(dyn_rx0_pma_ctle_cap_p)
X(dyn_rx0_pma_ctle_res_p)
X(dyn_rx0_pma_dfe_idac_tap1_n)
X(dyn_rx0_pma_dfe_idac_tap2_n)
X(dyn_rx0_pma_dfe_idac_tap3_n)
X(dyn_rx0_pma_dfe_idac_tap4_n)
X(dyn_rx0_pma_termination_cmd)
X(dyn_rx1_pma_ctle_cap_p)
X(dyn_rx1_pma_ctle_res_p)
X(dyn_rx1_pma_dfe_idac_tap1_n)
X(dyn_rx1_pma_dfe_idac_tap2_n)
X(dyn_rx1_pma_dfe_idac_tap3_n)
X(dyn_rx1_pma_dfe_idac_tap4_n)
X(dyn_rx1_pma_termination_cmd)
X(dyn_rx2_pma_ctle_cap_p)
X(dyn_rx2_pma_ctle_res_p)
X(dyn_rx2_pma_dfe_idac_tap1_n)
X(dyn_rx2_pma_dfe_idac_tap2_n)
X(dyn_rx2_pma_dfe_idac_tap3_n)
X(dyn_rx2_pma_dfe_idac_tap4_n)
X(dyn_rx2_pma_termination_cmd)
X(dyn_rx3_pma_ctle_cap_p)
X(dyn_rx3_pma_ctle_res_p)
X(dyn_rx3_pma_dfe_idac_tap1_n)
X(dyn_rx3_pma_dfe_idac_tap2_n)
X(dyn_rx3_pma_dfe_idac_tap3_n)
X(dyn_rx3_pma_dfe_idac_tap4_n)
X(dyn_rx3_pma_termination_cmd)
X(dyn_tx0_pma_main_en)
X(dyn_tx0_pma_main_sign)
X(dyn_tx0_pma_margin_input)
X(dyn_tx0_pma_margin_sel)
X(dyn_tx0_pma_post_en)
X(dyn_tx0_pma_post_sel)
X(dyn_tx0_pma_post_sign)
X(dyn_tx0_pma_pre_en)
X(dyn_tx0_pma_pre_sel)
X(dyn_tx0_pma_pre_sign)
X(dyn_tx1_pma_main_en)
X(dyn_tx1_pma_main_sign)
X(dyn_tx1_pma_margin_input)
X(dyn_tx1_pma_margin_sel)
X(dyn_tx1_pma_post_en)
X(dyn_tx1_pma_post_sel)
X(dyn_tx1_pma_post_sign)
X(dyn_tx1_pma_pre_en)
X(dyn_tx1_pma_pre_sel)
X(dyn_tx1_pma_pre_sign)
X(dyn_tx2_pma_main_en)
X(dyn_tx2_pma_main_sign)
X(dyn_tx2_pma_margin_input)
X(dyn_tx2_pma_margin_sel)
X(dyn_tx2_pma_post_en)
X(dyn_tx2_pma_post_sel)
X(dyn_tx2_pma_post_sign)
X(dyn_tx2_pma_pre_en)
X(dyn_tx2_pma_pre_sel)
X(dyn_tx2_pma_pre_sign)
X(dyn_tx3_pma_main_en)
X(dyn_tx3_pma_main_sign)
X(dyn_tx3_pma_margin_input)
X(dyn_tx3_pma_margin_sel)
X(dyn_tx3_pma_post_en)
X(dyn_tx3_pma_post_sel)
X(dyn_tx3_pma_post_sign)
X(dyn_tx3_pma_pre_en)
X(dyn_tx3_pma_pre_sel)
X(dyn_tx3_pma_pre_sign)
//X(location)
//X(main_clk_to_fabric_div_en)
//X(main_clk_to_fabric_div_mode)
//X(main_clk_to_fabric_sel)
X(main_rclk_to_fabric_sel)
//X(main_use_only_usr_clock)
X(pcs_ovs_en)
//X(pcs_ovs_mode)
X(pcs_pll_lock_ppm)
//X(pcs_word_len)
X(pll_pma_ckref_ext)
X(pll_pma_cpump)
X(pll_pma_divl)
//X(pll_pma_divm)
//X(pll_pma_divn)
X(pll_pma_gbx_en)
//X(pll_pma_int_data_len)
X(pll_pma_lvds_en)
//X(pll_pma_lvds_mux)
//X(pll_pma_mux_ckref)
//X(rx_usrclk_use_pcs_clk_2)
X(test_mode)
//X(tx_usrclk_use_pcs_clk_2)
// NX_R5_L
X(NX_R5_L)
// NX_R5_L_WRAP
X(NX_R5_L_WRAP)
// NX_RAM
X(NX_RAM)
X(mcka_edge)
X(mckb_edge)
X(mem_ctxt)
X(pcka_edge)
X(pckb_edge)
X(pipe_ia)
X(pipe_ib)
X(pipe_oa)
X(pipe_ob)
//X(raw_config0)
//X(raw_config1)
X(raw_l_enable)
X(raw_l_extend)
X(raw_u_enable)
X(raw_u_extend)
//X(std_mode)
// NX_RAM_SLOWECC_1K_36_1r1w
X(NX_RAM_SLOWECC_1K_36_1r1w)
//X(mem_ctxt)
// NX_RAM_WRAP
X(NX_RAM_WRAP)
//X(mcka_edge)
//X(mckb_edge)
//X(mem_ctxt)
//X(pcka_edge)
//X(pckb_edge)
//X(pipe_ia)
//X(pipe_ib)
//X(pipe_oa)
//X(pipe_ob)
//X(raw_config0)
//X(raw_config1)
//X(raw_l_enable)
//X(raw_l_extend)
//X(raw_u_enable)
//X(raw_u_extend)
//X(std_mode)
// NX_RB
X(NX_RB)
X(inputBypass)
X(inputClk)
X(inputContext)
X(outputBypass)
X(outputClk)
X(outputContext)
// NX_RB_WRAP
X(NX_RB_WRAP)
//X(inputBypass)
//X(inputClk)
//X(inputContext)
//X(outputBypass)
//X(outputClk)
//X(outputContext)
// NX_RFB
X(NX_RFB)
X(addr_mask)
//X(mem_ctxt)
//X(rck_edge)
//X(wck_edge)
X(we_mask)
X(wea_mask)
// NX_RFBDP_U_WRAP
X(NX_RFBDP_U_WRAP)
//X(mem_ctxt)
//X(wck_edge)
// NX_RFBSP_U_WRAP
X(NX_RFBSP_U_WRAP)
//X(mem_ctxt)
//X(wck_edge)
// NX_RFB_L
X(NX_RFB_L)
//X(mem_ctxt)
//X(mode)
//X(rck_edge)
//X(wck_edge)
// NX_RFB_L_WRAP
X(NX_RFB_L_WRAP)
//X(mem_ctxt)
//X(mode)
//X(rck_edge)
//X(wck_edge)
// NX_RFB_M
X(NX_RFB_M)
//X(mem_ctxt)
//X(rck_edge)
//X(wck_edge)
// NX_RFB_U
X(NX_RFB_U)
//X(mem_ctxt)
//X(mode)
//X(wck_edge)
// NX_RFB_WRAP
X(NX_RFB_WRAP)
//X(mem_ctxt)
//X(rck_edge)
//X(wck_edge)
// NX_SER
X(NX_SER)
//X(data_size)
//X(differential)
//X(drive)
//X(location)
//X(locked)
//X(outputCapacity)
//X(outputDelayLine)
//X(slewRate)
X(spath_dynamic)
//X(standard)
// NX_SERDES
X(NX_SERDES)
X(cpath_registered)
//X(data_size)
//X(differential)
//X(dpath_dynamic)
//X(drive)
//X(inputDelayLine)
//X(inputSignalSlope)
//X(location)
//X(locked)
//X(outputCapacity)
//X(outputDelayLine)
//X(slewRate)
//X(spath_dynamic)
//X(standard)
//X(termination)
//X(terminationReference)
//X(turbo)
//X(weakTermination)
// NX_WFG
X(NX_WFG)
X(delay)
X(delay_on)
//X(location)
//X(mode)
X(pattern)
X(pattern_end)
X(wfg_edge)
// NX_WFG_L
X(NX_WFG_L)
//X(delay)
//X(delay_on)
//X(location)
//X(mode)
//X(pattern)
//X(pattern_end)
//X(wfg_edge)
// NX_WFG_U
X(NX_WFG_U)
//X(delay)
//X(delay_on)
X(div_phase)
X(div_ratio)
//X(location)
//X(mode)
//X(pattern)
//X(pattern_end)
X(reset_on_cal_lock_n)
X(reset_on_pll_lock_n)
X(reset_on_pll_locka_n)
//X(wfg_edge)
// NX_XCDC_U
X(NX_XCDC_U)
//X(ack_sel)
//X(bck_sel)
//X(cck_sel)
//X(ck0_edge)
//X(ck1_edge)
//X(dck_sel)
//X(link_BA)
//X(link_CB)
//X(link_DC)
//X(use_adest_arst)
//X(use_asrc_arst)
//X(use_bdest_arst)
//X(use_bsrc_arst)
//X(use_cdest_arst)
//X(use_csrc_arst)
//X(use_ddest_arst)
//X(use_dsrc_arst)
// NX_XFIFO_32x36
X(NX_XFIFO_32x36)
//X(rck_edge)
//X(read_addr_inv)
//X(use_read_arst)
//X(use_write_arst)
//X(wck_edge)
// NX_XFIFO_64x18
X(NX_XFIFO_64x18)
//X(rck_edge)
//X(read_addr_inv)
//X(use_read_arst)
//X(use_write_arst)
//X(wck_edge)
// NX_XRFB_2R_1W
X(NX_XRFB_2R_1W)
//X(mem_ctxt)
//X(wck_edge)
// NX_XRFB_32x36
X(NX_XRFB_32x36)
//X(mem_ctxt)
//X(wck_edge)
// NX_XRFB_64x18
X(NX_XRFB_64x18)
//X(mem_ctxt)
//X(wck_edge)
// end of generated parameter list
// IO location attribute
X(LOC)
X(lut_used)
X(dff_used)
X(type)
// Timing
X(BEYOND_FE_LUT)
// csv
X(registered)
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