pluto_hdl_adi/projects/ad4134_fmc/Makefile

####################################################################################
## Copyright (c) 2018 - 2021 Analog Devices, Inc.
### SPDX short identifier: BSD-1-Clause
## Auto-generated, do not modify!
####################################################################################

include ../scripts/project-toplevel.mk
projects/ad4134_fmc: Initial commit add support * Updated reference design: spi trigger, ODR parameters - enabled ext_clk for PWM to use 96 MHz spi clk - mofified PWM channels used: - ch1: ODR - 850 ns period, 130 ns high time ==> max fODR = 1.18 MHz - ch0: trigger - 850 ns period, 30 phase shift ==> 10 ns between falling ODR rising DCLK - spi offload trigger signal: PWM trigger used * Moved mem_interconnect to hp1 * Added dclkio GPIO * Updated bd SPIE hierarchy, see library/spi_engine.tcl Signed-off-by: laurent-19 <laurentiu.popa@analog.com> 2022-05-06 13:08:39 +00:00			`####################################################################################`
			`## Copyright (c) 2018 - 2021 Analog Devices, Inc.`
			`### SPDX short identifier: BSD-1-Clause`
			`## Auto-generated, do not modify!`
			`####################################################################################`

			`include ../scripts/project-toplevel.mk`