gt_es: support lpm mode - 2/2
parent
0a8e6f62ef
commit
1e7c9a3924
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@ -79,6 +79,7 @@ module ad_gt_es (
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es_start,
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es_stop,
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es_init,
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es_lpm_dfe_n,
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es_sdata0,
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es_sdata1,
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es_sdata2,
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@ -224,6 +225,7 @@ module ad_gt_es (
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input es_start;
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||||
input es_stop;
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||||
input es_init;
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||||
input es_lpm_dfe_n;
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||||
input [15:0] es_sdata0;
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||||
input [15:0] es_sdata1;
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||||
input [15:0] es_sdata2;
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||||
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@ -292,6 +294,7 @@ module ad_gt_es (
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wire es_dma_ack_s;
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wire es_heos_s;
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wire es_eos_s;
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wire es_ut_s;
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wire [ 7:0] es_voffset_2_s;
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wire [ 7:0] es_voffset_n_s;
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wire [ 7:0] es_voffset_s;
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||||
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@ -413,6 +416,7 @@ module ad_gt_es (
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assign es_heos_s = (es_hoffset == es_hoffset_max) ? es_ut : 1'b0;
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assign es_eos_s = (es_voffset == es_voffset_max) ? es_heos_s : 1'b0;
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||||
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assign es_ut_s = es_ut & ~es_lpm_dfe_n;
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||||
assign es_voffset_2_s = ~es_voffset + 1'b1;
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assign es_voffset_n_s = {1'b1, es_voffset_2_s[6:0]};
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||||
assign es_voffset_s = (es_voffset[7] == 1'b1) ? es_voffset_n_s : es_voffset;
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||||
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@ -424,12 +428,12 @@ module ad_gt_es (
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es_status <= 1'b1;
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||||
end
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if (es_fsm == ES_FSM_IDLE) begin
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es_ut <= 1'b0;
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es_ut <= es_lpm_dfe_n;
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es_dma_addr_int <= es_start_addr;
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es_hoffset <= es_hoffset_min;
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es_voffset <= es_voffset_min;
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end else if (es_fsm == ES_FSM_UPDATE) begin
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es_ut <= ~es_ut;
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es_ut <= ~es_ut | es_lpm_dfe_n;
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es_dma_addr_int <= es_dma_addr_int + 3'd4;
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||||
if (es_heos_s == 1'b1) begin
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||||
es_hoffset <= es_hoffset_min;
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@ -868,9 +872,9 @@ module ad_gt_es (
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es_wr <= 1'b1;
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es_addr <= ES_DRP_VOFFSET_ADDR;
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||||
if (GTH_GTX_N == 1) begin
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||||
es_wdata <= {es_voffset_rdata[15:11], es_voffset_s[7], es_ut, es_voffset_s[6:0], es_voffset_range};
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||||
es_wdata <= {es_voffset_rdata[15:11], es_voffset_s[7], es_ut_s, es_voffset_s[6:0], es_voffset_range};
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||||
end else begin
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||||
es_wdata <= {es_prescale, es_voffset_rdata[10:9], es_ut, es_voffset_s};
|
||||
es_wdata <= {es_prescale, es_voffset_rdata[10:9], es_ut_s, es_voffset_s};
|
||||
end
|
||||
end
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||||
ES_FSM_CTRLSTART_READ: begin
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