axi_spi_engine: Fix level/room width for the CDC FIFOs
parent
c718ba91f1
commit
22ce3ef9ce
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@ -134,14 +134,14 @@ module axi_spi_engine #(
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wire clk;
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wire rstn;
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wire [CMD_FIFO_ADDRESS_WIDTH:0] cmd_fifo_room;
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wire [CMD_FIFO_ADDRESS_WIDTH-1:0] cmd_fifo_room;
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wire cmd_fifo_almost_empty;
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wire [15:0] cmd_fifo_in_data;
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wire cmd_fifo_in_ready;
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wire cmd_fifo_in_valid;
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wire [SDO_FIFO_ADDRESS_WIDTH:0] sdo_fifo_room;
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wire [SDO_FIFO_ADDRESS_WIDTH-1:0] sdo_fifo_room;
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wire sdo_fifo_almost_empty;
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wire [(DATA_WIDTH-1):0] sdo_fifo_in_data;
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@ -149,7 +149,7 @@ module axi_spi_engine #(
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wire sdo_fifo_in_valid;
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wire sdi_fifo_out_data_msb_s;
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wire [SDI_FIFO_ADDRESS_WIDTH:0] sdi_fifo_level;
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wire [SDI_FIFO_ADDRESS_WIDTH-1:0] sdi_fifo_level;
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wire sdi_fifo_almost_full;
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wire [(NUM_OF_SDI * DATA_WIDTH-1):0] sdi_fifo_out_data;
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@ -400,7 +400,7 @@ module axi_spi_engine #(
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assign cmd_fifo_in_valid = up_wreq_s == 1'b1 && up_waddr_s == 8'h38;
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assign cmd_fifo_in_data = up_wdata_s[15:0];
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assign cmd_fifo_almost_empty =
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`axi_spi_engine_check_watermark(cmd_fifo_room, CMD_FIFO_ADDRESS_WIDTH);
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`axi_spi_engine_check_watermark(cmd_fifo_room, CMD_FIFO_ADDRESS_WIDTH-1);
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util_axis_fifo #(
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.DATA_WIDTH(16),
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@ -427,7 +427,7 @@ module axi_spi_engine #(
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assign sdo_fifo_in_valid = up_wreq_s == 1'b1 && up_waddr_s == 8'h39;
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assign sdo_fifo_in_data = up_wdata_s[(DATA_WIDTH-1):0];
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assign sdo_fifo_almost_empty =
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`axi_spi_engine_check_watermark(sdo_fifo_room, SDO_FIFO_ADDRESS_WIDTH);
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`axi_spi_engine_check_watermark(sdo_fifo_room, SDO_FIFO_ADDRESS_WIDTH-1);
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util_axis_fifo #(
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.DATA_WIDTH(DATA_WIDTH),
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@ -453,7 +453,7 @@ module axi_spi_engine #(
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assign sdi_fifo_out_ready = up_rreq_s == 1'b1 && up_raddr_s == 8'h3a;
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assign sdi_fifo_almost_full =
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||||
`axi_spi_engine_check_watermark(sdi_fifo_level, SDI_FIFO_ADDRESS_WIDTH);
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`axi_spi_engine_check_watermark(sdi_fifo_level, SDI_FIFO_ADDRESS_WIDTH-1);
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||||
util_axis_fifo #(
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.DATA_WIDTH(NUM_OF_SDI * DATA_WIDTH),
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