adv7511_zc702: Update project to the new framework.
parent
d1e4727066
commit
2d05193093
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@ -1,9 +1,3 @@
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source $ad_hdl_dir/projects/common/zc702/zc702_system_bd.tcl
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source $ad_hdl_dir/projects/common/zc702/zc702_system_bd.tcl
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set_property -dict [list CONFIG.PCW_GPIO_EMIO_GPIO_IO {32}] $sys_ps7
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set_property -dict [list CONFIG.NUM_MI {7}] $axi_cpu_interconnect
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set_property LEFT 31 [get_bd_ports GPIO_I]
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set_property LEFT 31 [get_bd_ports GPIO_O]
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set_property LEFT 31 [get_bd_ports GPIO_T]
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@ -1,8 +1,7 @@
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source ../../scripts/adi_env.tcl
|
source ../../scripts/adi_env.tcl
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source $ad_hdl_dir/projects/scripts/adi_project.tcl
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source $ad_hdl_dir/projects/scripts/adi_project.tcl
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source $ad_hdl_dir/projects/scripts/adi_board.tcl
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adi_project_create adv7511_zc702
|
adi_project_create adv7511_zc702
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adi_project_files adv7511_zc702 [list \
|
adi_project_files adv7511_zc702 [list \
|
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@ -12,4 +11,3 @@ adi_project_files adv7511_zc702 [list \
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adi_project_run adv7511_zc702
|
adi_project_run adv7511_zc702
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@ -41,28 +41,28 @@
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module system_top (
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module system_top (
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DDR_addr,
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ddr_addr,
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DDR_ba,
|
ddr_ba,
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DDR_cas_n,
|
ddr_cas_n,
|
||||||
DDR_ck_n,
|
ddr_ck_n,
|
||||||
DDR_ck_p,
|
ddr_ck_p,
|
||||||
DDR_cke,
|
ddr_cke,
|
||||||
DDR_cs_n,
|
ddr_cs_n,
|
||||||
DDR_dm,
|
ddr_dm,
|
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DDR_dq,
|
ddr_dq,
|
||||||
DDR_dqs_n,
|
ddr_dqs_n,
|
||||||
DDR_dqs_p,
|
ddr_dqs_p,
|
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DDR_odt,
|
ddr_odt,
|
||||||
DDR_ras_n,
|
ddr_ras_n,
|
||||||
DDR_reset_n,
|
ddr_reset_n,
|
||||||
DDR_we_n,
|
ddr_we_n,
|
||||||
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||||||
FIXED_IO_ddr_vrn,
|
fixed_io_ddr_vrn,
|
||||||
FIXED_IO_ddr_vrp,
|
fixed_io_ddr_vrp,
|
||||||
FIXED_IO_mio,
|
fixed_io_mio,
|
||||||
FIXED_IO_ps_clk,
|
fixed_io_ps_clk,
|
||||||
FIXED_IO_ps_porb,
|
fixed_io_ps_porb,
|
||||||
FIXED_IO_ps_srstb,
|
fixed_io_ps_srstb,
|
||||||
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||||||
gpio_bd,
|
gpio_bd,
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@ -77,28 +77,28 @@ module system_top (
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iic_scl,
|
iic_scl,
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iic_sda);
|
iic_sda);
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inout [14:0] DDR_addr;
|
inout [14:0] ddr_addr;
|
||||||
inout [ 2:0] DDR_ba;
|
inout [ 2:0] ddr_ba;
|
||||||
inout DDR_cas_n;
|
inout ddr_cas_n;
|
||||||
inout DDR_ck_n;
|
inout ddr_ck_n;
|
||||||
inout DDR_ck_p;
|
inout ddr_ck_p;
|
||||||
inout DDR_cke;
|
inout ddr_cke;
|
||||||
inout DDR_cs_n;
|
inout ddr_cs_n;
|
||||||
inout [ 3:0] DDR_dm;
|
inout [ 3:0] ddr_dm;
|
||||||
inout [31:0] DDR_dq;
|
inout [31:0] ddr_dq;
|
||||||
inout [ 3:0] DDR_dqs_n;
|
inout [ 3:0] ddr_dqs_n;
|
||||||
inout [ 3:0] DDR_dqs_p;
|
inout [ 3:0] ddr_dqs_p;
|
||||||
inout DDR_odt;
|
inout ddr_odt;
|
||||||
inout DDR_ras_n;
|
inout ddr_ras_n;
|
||||||
inout DDR_reset_n;
|
inout ddr_reset_n;
|
||||||
inout DDR_we_n;
|
inout ddr_we_n;
|
||||||
|
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||||||
inout FIXED_IO_ddr_vrn;
|
inout fixed_io_ddr_vrn;
|
||||||
inout FIXED_IO_ddr_vrp;
|
inout fixed_io_ddr_vrp;
|
||||||
inout [53:0] FIXED_IO_mio;
|
inout [53:0] fixed_io_mio;
|
||||||
inout FIXED_IO_ps_clk;
|
inout fixed_io_ps_clk;
|
||||||
inout FIXED_IO_ps_porb;
|
inout fixed_io_ps_porb;
|
||||||
inout FIXED_IO_ps_srstb;
|
inout fixed_io_ps_srstb;
|
||||||
|
|
||||||
inout [15:0] gpio_bd;
|
inout [15:0] gpio_bd;
|
||||||
|
|
||||||
|
@ -115,47 +115,45 @@ module system_top (
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||||||
|
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||||||
// internal signals
|
// internal signals
|
||||||
|
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||||||
wire [15:0] gpio_i;
|
wire [63:0] gpio_i;
|
||||||
wire [15:0] gpio_o;
|
wire [63:0] gpio_o;
|
||||||
wire [15:0] gpio_t;
|
wire [63:0] gpio_t;
|
||||||
|
|
||||||
wire [15:0] ps_intrs;
|
|
||||||
|
|
||||||
// instantiations
|
// instantiations
|
||||||
|
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||||||
ad_iobuf #(
|
ad_iobuf #(
|
||||||
.DATA_WIDTH(16)
|
.DATA_WIDTH(16)
|
||||||
) i_gpio_bd (
|
) i_gpio_bd (
|
||||||
.dt(gpio_t),
|
.dt(gpio_t[15:0]),
|
||||||
.di(gpio_o),
|
.di(gpio_o[15:0]),
|
||||||
.do(gpio_i),
|
.do(gpio_i[15:0]),
|
||||||
.dio(gpio_bd));
|
.dio(gpio_bd));
|
||||||
|
|
||||||
system_wrapper i_system_wrapper (
|
system_wrapper i_system_wrapper (
|
||||||
.DDR_addr (DDR_addr),
|
.ddr_addr (ddr_addr),
|
||||||
.DDR_ba (DDR_ba),
|
.ddr_ba (ddr_ba),
|
||||||
.DDR_cas_n (DDR_cas_n),
|
.ddr_cas_n (ddr_cas_n),
|
||||||
.DDR_ck_n (DDR_ck_n),
|
.ddr_ck_n (ddr_ck_n),
|
||||||
.DDR_ck_p (DDR_ck_p),
|
.ddr_ck_p (ddr_ck_p),
|
||||||
.DDR_cke (DDR_cke),
|
.ddr_cke (ddr_cke),
|
||||||
.DDR_cs_n (DDR_cs_n),
|
.ddr_cs_n (ddr_cs_n),
|
||||||
.DDR_dm (DDR_dm),
|
.ddr_dm (ddr_dm),
|
||||||
.DDR_dq (DDR_dq),
|
.ddr_dq (ddr_dq),
|
||||||
.DDR_dqs_n (DDR_dqs_n),
|
.ddr_dqs_n (ddr_dqs_n),
|
||||||
.DDR_dqs_p (DDR_dqs_p),
|
.ddr_dqs_p (ddr_dqs_p),
|
||||||
.DDR_odt (DDR_odt),
|
.ddr_odt (ddr_odt),
|
||||||
.DDR_ras_n (DDR_ras_n),
|
.ddr_ras_n (ddr_ras_n),
|
||||||
.DDR_reset_n (DDR_reset_n),
|
.ddr_reset_n (ddr_reset_n),
|
||||||
.DDR_we_n (DDR_we_n),
|
.ddr_we_n (ddr_we_n),
|
||||||
.FIXED_IO_ddr_vrn (FIXED_IO_ddr_vrn),
|
.fixed_io_ddr_vrn (fixed_io_ddr_vrn),
|
||||||
.FIXED_IO_ddr_vrp (FIXED_IO_ddr_vrp),
|
.fixed_io_ddr_vrp (fixed_io_ddr_vrp),
|
||||||
.FIXED_IO_mio (FIXED_IO_mio),
|
.fixed_io_mio (fixed_io_mio),
|
||||||
.FIXED_IO_ps_clk (FIXED_IO_ps_clk),
|
.fixed_io_ps_clk (fixed_io_ps_clk),
|
||||||
.FIXED_IO_ps_porb (FIXED_IO_ps_porb),
|
.fixed_io_ps_porb (fixed_io_ps_porb),
|
||||||
.FIXED_IO_ps_srstb (FIXED_IO_ps_srstb),
|
.fixed_io_ps_srstb (fixed_io_ps_srstb),
|
||||||
.GPIO_I (gpio_i),
|
.gpio_i (gpio_i),
|
||||||
.GPIO_O (gpio_o),
|
.gpio_o (gpio_o),
|
||||||
.GPIO_T (gpio_t),
|
.gpio_t (gpio_t),
|
||||||
.hdmi_data (hdmi_data),
|
.hdmi_data (hdmi_data),
|
||||||
.hdmi_data_e (hdmi_data_e),
|
.hdmi_data_e (hdmi_data_e),
|
||||||
.hdmi_hsync (hdmi_hsync),
|
.hdmi_hsync (hdmi_hsync),
|
||||||
|
@ -163,20 +161,20 @@ module system_top (
|
||||||
.hdmi_vsync (hdmi_vsync),
|
.hdmi_vsync (hdmi_vsync),
|
||||||
.iic_main_scl_io (iic_scl),
|
.iic_main_scl_io (iic_scl),
|
||||||
.iic_main_sda_io (iic_sda),
|
.iic_main_sda_io (iic_sda),
|
||||||
.ps_intr_0 (ps_intrs[0]),
|
.ps_intr_00 (1'b0),
|
||||||
.ps_intr_1 (ps_intrs[1]),
|
.ps_intr_01 (1'b0),
|
||||||
.ps_intr_2 (ps_intrs[2]),
|
.ps_intr_02 (1'b0),
|
||||||
.ps_intr_3 (ps_intrs[3]),
|
.ps_intr_03 (1'b0),
|
||||||
.ps_intr_4 (ps_intrs[4]),
|
.ps_intr_04 (1'b0),
|
||||||
.ps_intr_5 (ps_intrs[5]),
|
.ps_intr_05 (1'b0),
|
||||||
.ps_intr_6 (ps_intrs[6]),
|
.ps_intr_06 (1'b0),
|
||||||
.ps_intr_7 (ps_intrs[7]),
|
.ps_intr_07 (1'b0),
|
||||||
.ps_intr_8 (ps_intrs[8]),
|
.ps_intr_08 (1'b0),
|
||||||
.ps_intr_9 (ps_intrs[9]),
|
.ps_intr_09 (1'b0),
|
||||||
.ps_intr_10 (ps_intrs[10]),
|
.ps_intr_10 (1'b0),
|
||||||
.ps_intr_11 (ps_intrs[11]),
|
.ps_intr_11 (1'b0),
|
||||||
.ps_intr_12 (ps_intrs[12]),
|
.ps_intr_12 (1'b0),
|
||||||
.ps_intr_13 (ps_intrs[13]),
|
.ps_intr_13 (1'b0),
|
||||||
.spdif (spdif));
|
.spdif (spdif));
|
||||||
|
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||||||
endmodule
|
endmodule
|
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