ad_serdes- updates
parent
631923e9f0
commit
4a6b554c0a
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@ -47,6 +47,7 @@ module ad_serdes_in (
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input div_clk,
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input loaden,
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input hs_phase,
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input locked,
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// data interface
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@ -81,13 +82,13 @@ module ad_serdes_in (
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// instantiations
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alt_serdes_in_core i_core (
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.data_in (data_in_p),
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.clk (clk),
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.loaden (loaden),
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||||
.div_clk (div_clk),
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||||
.hs_phase (hs_phase),
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||||
.locked (locked),
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||||
.data_s ({data_s7,
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||||
.clk_export (clk),
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||||
.div_clk_export (div_clk),
|
||||
.hs_phase_export (hs_phase),
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||||
.loaden_export (loaden),
|
||||
.locked_export (locked),
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||||
.data_in_export (data_in_p),
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||||
.data_s_export ({ data_s7,
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data_s6,
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data_s5,
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data_s4,
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@ -95,7 +96,7 @@ module ad_serdes_in (
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data_s2,
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data_s1,
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data_s0}),
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.delay_locked (delay_locked));
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.delay_locked_export (delay_locked));
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endmodule
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@ -80,11 +80,11 @@ module ad_serdes_out (
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generate
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for (l_inst = 0; l_inst < DATA_WIDTH; l_inst = l_inst + 1) begin: g_data
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alt_serdes_out_core i_core (
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.data_out (data_out_p[l_inst]),
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||||
.clk (clk),
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.loaden (loaden),
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||||
.div_clk (div_clk),
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||||
.data_s ({data_s7[l_inst],
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.clk_export (clk),
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||||
.div_clk_export (div_clk),
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||||
.loaden_export (loaden),
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||||
.data_out_export (data_out_p[l_inst]),
|
||||
.data_s_export ({ data_s7[l_inst],
|
||||
data_s6[l_inst],
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||||
data_s5[l_inst],
|
||||
data_s4[l_inst],
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