axi_mc_speed: updated core to latest axi interface implementation
parent
26f58914e2
commit
a70d27c094
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@ -96,7 +96,8 @@ module axi_mc_speed
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reg adc_valid = 'd0;
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reg adc_valid = 'd0;
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reg [31:0] adc_data = 'd0;
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reg [31:0] adc_data = 'd0;
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reg [31:0] up_rdata = 'd0;
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reg [31:0] up_rdata = 'd0;
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reg up_ack = 'd0;
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reg up_wack = 'd0;
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reg up_rack = 'd0;
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//------------------------------------------------------------------------------
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//------------------------------------------------------------------------------
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//----------- Wires Declarations -----------------------------------------------
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//----------- Wires Declarations -----------------------------------------------
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@ -113,12 +114,14 @@ wire adc_start_s;
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wire [31:0] speed_data_s;
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wire [31:0] speed_data_s;
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wire adc_enable_s;
|
wire adc_enable_s;
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||||||
wire adc_status_s;
|
wire adc_status_s;
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||||||
wire up_sel_s;
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wire up_rreq_s;
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wire up_wr_s;
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wire up_wreq_s;
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wire [13:0] up_addr_s;
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wire [13:0] up_waddr_s;
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||||||
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wire [13:0] up_raddr_s;
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||||||
wire [31:0] up_wdata_s;
|
wire [31:0] up_wdata_s;
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||||||
wire [31:0] up_adc_common_rdata_s;
|
wire [31:0] up_adc_common_rdata_s;
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||||||
wire up_adc_common_ack_s;
|
wire up_adc_common_wack_s;
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||||||
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wire up_adc_common_rack_s;
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wire [31:0] pid_s;
|
wire [31:0] pid_s;
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wire [ 2:0] position_s;
|
wire [ 2:0] position_s;
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@ -164,11 +167,13 @@ begin
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if(up_rstn == 0)
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if(up_rstn == 0)
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begin
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begin
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up_rdata <= 'd0;
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up_rdata <= 'd0;
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||||||
up_ack <= 'd0;
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up_wack <= 'd0;
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up_rack <= 'd0;
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end else
|
end else
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begin
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begin
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up_rdata <= up_adc_common_rdata_s;
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up_rdata <= up_adc_common_rdata_s;
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||||||
up_ack <= up_adc_common_ack_s;
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up_wack <= up_adc_common_wack_s;
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||||||
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up_rack <= up_adc_common_rack_s;
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||||||
end
|
end
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||||||
end
|
end
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@ -275,15 +280,19 @@ up_adc_common i_up_adc_common(
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.drp_locked(1'b0),
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.drp_locked(1'b0),
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||||||
.up_usr_chanmax(),
|
.up_usr_chanmax(),
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||||||
.adc_usr_chanmax(8'd0),
|
.adc_usr_chanmax(8'd0),
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||||||
|
.up_adc_gpio_in(),
|
||||||
|
.up_adc_gpio_out(),
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||||||
.up_rstn(up_rstn),
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.up_rstn(up_rstn),
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||||||
.up_clk(up_clk),
|
.up_clk(up_clk),
|
||||||
.up_sel(up_sel_s),
|
.up_wreq (up_wreq_s),
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||||||
.up_wr(up_wr_s),
|
.up_waddr (up_waddr_s),
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||||||
.up_addr(up_addr_s),
|
.up_wdata (up_wdata_s),
|
||||||
.up_wdata(up_wdata_s),
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.up_wack (up_adc_common_wack_s),
|
||||||
.up_rdata(up_adc_common_rdata_s),
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.up_rreq (up_rreq_s),
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||||||
.up_ack(up_adc_common_ack_s)
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.up_raddr (up_raddr_s),
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||||||
);
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.up_rdata (up_adc_common_rdata_s),
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||||||
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.up_rack (up_adc_common_rack_s));
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// up bus interface
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// up bus interface
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||||||
up_axi i_up_axi(
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up_axi i_up_axi(
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@ -306,12 +315,14 @@ up_axi i_up_axi(
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.up_axi_rresp(s_axi_rresp),
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.up_axi_rresp(s_axi_rresp),
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||||||
.up_axi_rdata(s_axi_rdata),
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.up_axi_rdata(s_axi_rdata),
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||||||
.up_axi_rready(s_axi_rready),
|
.up_axi_rready(s_axi_rready),
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||||||
.up_sel(up_sel_s),
|
.up_wreq (up_wreq_s),
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||||||
.up_wr(up_wr_s),
|
.up_waddr (up_waddr_s),
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||||||
.up_addr(up_addr_s),
|
.up_wdata (up_wdata_s),
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||||||
.up_wdata(up_wdata_s),
|
.up_wack (up_wack),
|
||||||
.up_rdata(up_rdata),
|
.up_rreq (up_rreq_s),
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||||||
.up_ack(up_ack));
|
.up_raddr (up_raddr_s),
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||||||
|
.up_rdata (up_rdata),
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||||||
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.up_rack (up_rack));
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||||||
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endmodule
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endmodule
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||||||
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