From c1148889569a76e3ba25e47ade9623c48287cdc9 Mon Sep 17 00:00:00 2001 From: Rejeesh Kutty Date: Thu, 8 Dec 2016 10:33:35 -0500 Subject: [PATCH] usdrx1- updates --- projects/usdrx1/a5gt/system_qsys.tcl | 6 + projects/usdrx1/common/usdrx1_qsys.tcl | 204 +++++++++++++++++++++++++ 2 files changed, 210 insertions(+) create mode 100644 projects/usdrx1/a5gt/system_qsys.tcl create mode 100644 projects/usdrx1/common/usdrx1_qsys.tcl diff --git a/projects/usdrx1/a5gt/system_qsys.tcl b/projects/usdrx1/a5gt/system_qsys.tcl new file mode 100644 index 000000000..968d1161c --- /dev/null +++ b/projects/usdrx1/a5gt/system_qsys.tcl @@ -0,0 +1,6 @@ + +source $ad_hdl_dir/projects/common/a5gt/a5gt_system_qsys.tcl +source ../common/usdrx1_qsys.tcl + +save_system "system_bd.qsys" + diff --git a/projects/usdrx1/common/usdrx1_qsys.tcl b/projects/usdrx1/common/usdrx1_qsys.tcl new file mode 100644 index 000000000..a8221c713 --- /dev/null +++ b/projects/usdrx1/common/usdrx1_qsys.tcl @@ -0,0 +1,204 @@ + +# usdrx1-xcvr + +add_instance avl_usdrx1_xcvr avl_adxcvr 1.0 +set_instance_parameter_value avl_usdrx1_xcvr {ID} {1} +set_instance_parameter_value avl_usdrx1_xcvr {TX_OR_RX_N} {0} +set_instance_parameter_value avl_usdrx1_xcvr {PCS_CONFIG} {JESD_PCS_CFG1} +set_instance_parameter_value avl_usdrx1_xcvr {LANE_RATE} {3200.0} +set_instance_parameter_value avl_usdrx1_xcvr {PLLCLK_FREQUENCY} {1600.0} +set_instance_parameter_value avl_usdrx1_xcvr {REFCLK_FREQUENCY} {80.0} +set_instance_parameter_value avl_usdrx1_xcvr {CORECLK_FREQUENCY} {80.0} +set_instance_parameter_value avl_usdrx1_xcvr {NUM_OF_LANES} {8} +set_instance_parameter_value avl_usdrx1_xcvr {NUM_OF_CONVS} {32} +set_instance_parameter_value avl_usdrx1_xcvr {FRM_BCNT} {4} +set_instance_parameter_value avl_usdrx1_xcvr {FRM_SCNT} {1} +set_instance_parameter_value avl_usdrx1_xcvr {MF_FCNT} {32} +set_instance_parameter_value avl_usdrx1_xcvr {HD} {0} + +add_connection sys_clk.clk avl_usdrx1_xcvr.sys_clk +add_connection sys_clk.clk_reset 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axi_ad9671_core_2 axi_ad9671 1.0 + +add_connection avl_usdrx1_xcvr.core_clk axi_ad9671_core_2.if_rx_clk +add_interface rx_ip_sof_2 conduit end +set_interface_property rx_ip_sof_2 EXPORT_OF axi_ad9671_core_2.if_rx_sof +add_interface rx_ip_data_2 avalon_streaming sink +set_interface_property rx_ip_data_2 EXPORT_OF axi_ad9671_core_2.if_rx_data +add_connection sys_clk.clk_reset axi_ad9671_core_2.s_axi_reset +add_connection sys_clk.clk axi_ad9671_core_2.s_axi_clock + +add_instance axi_ad9671_core_3 axi_ad9671 1.0 + +add_connection avl_usdrx1_xcvr.core_clk axi_ad9671_core_3.if_rx_clk +add_interface rx_ip_sof_3 conduit end +set_interface_property rx_ip_sof_3 EXPORT_OF axi_ad9671_core_3.if_rx_sof +add_interface rx_ip_data_3 avalon_streaming sink +set_interface_property rx_ip_data_3 EXPORT_OF axi_ad9671_core_3.if_rx_data +add_connection sys_clk.clk_reset axi_ad9671_core_3.s_axi_reset +add_connection sys_clk.clk axi_ad9671_core_3.s_axi_clock + +# usdrx1-pack + +add_instance util_usdrx1_cpack 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