fmcadc4: 2014.4 updates
Rejeesh Kutty
parent
9e1e4969ff
commit
cba3dde3dc
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@ -41,48 +41,28 @@
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module system_top (
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module system_top (
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sys_rst,
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ddr_addr,
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sys_clk_p,
|
ddr_ba,
|
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sys_clk_n,
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ddr_cas_n,
|
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|
ddr_ck_n,
|
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|
ddr_ck_p,
|
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ddr_cke,
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ddr_cs_n,
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ddr_dm,
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ddr_dq,
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ddr_dqs_n,
|
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ddr_dqs_p,
|
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ddr_odt,
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ddr_ras_n,
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ddr_reset_n,
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ddr_we_n,
|
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DDR3_addr,
|
fixed_io_ddr_vrn,
|
||||||
DDR3_ba,
|
fixed_io_ddr_vrp,
|
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DDR3_cas_n,
|
fixed_io_mio,
|
||||||
DDR3_ck_n,
|
fixed_io_ps_clk,
|
||||||
DDR3_ck_p,
|
fixed_io_ps_porb,
|
||||||
DDR3_cke,
|
fixed_io_ps_srstb,
|
||||||
DDR3_cs_n,
|
|
||||||
DDR3_dm,
|
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||||||
DDR3_dq,
|
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DDR3_dqs_n,
|
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DDR3_dqs_p,
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DDR3_odt,
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DDR3_ras_n,
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DDR3_reset_n,
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DDR3_we_n,
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DDR_addr,
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DDR_ba,
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DDR_cas_n,
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DDR_ck_n,
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DDR_ck_p,
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DDR_cke,
|
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DDR_cs_n,
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DDR_dm,
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DDR_dq,
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DDR_dqs_n,
|
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||||||
DDR_dqs_p,
|
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||||||
DDR_odt,
|
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DDR_ras_n,
|
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DDR_reset_n,
|
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DDR_we_n,
|
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FIXED_IO_ddr_vrn,
|
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FIXED_IO_ddr_vrp,
|
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FIXED_IO_mio,
|
|
||||||
FIXED_IO_ps_clk,
|
|
||||||
FIXED_IO_ps_porb,
|
|
||||||
FIXED_IO_ps_srstb,
|
|
||||||
|
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||||||
gpio_bd,
|
gpio_bd,
|
||||||
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||||||
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@ -94,6 +74,26 @@ module system_top (
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spdif,
|
spdif,
|
||||||
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sys_rst,
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sys_clk_p,
|
||||||
|
sys_clk_n,
|
||||||
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|
ddr3_addr,
|
||||||
|
ddr3_ba,
|
||||||
|
ddr3_cas_n,
|
||||||
|
ddr3_ck_n,
|
||||||
|
ddr3_ck_p,
|
||||||
|
ddr3_cke,
|
||||||
|
ddr3_cs_n,
|
||||||
|
ddr3_dm,
|
||||||
|
ddr3_dq,
|
||||||
|
ddr3_dqs_n,
|
||||||
|
ddr3_dqs_p,
|
||||||
|
ddr3_odt,
|
||||||
|
ddr3_ras_n,
|
||||||
|
ddr3_reset_n,
|
||||||
|
ddr3_we_n,
|
||||||
|
|
||||||
iic_scl,
|
iic_scl,
|
||||||
iic_sda,
|
iic_sda,
|
||||||
|
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||||||
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|
@ -125,48 +125,28 @@ module system_top (
|
||||||
spi_clk,
|
spi_clk,
|
||||||
spi_sdio);
|
spi_sdio);
|
||||||
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||||||
input sys_rst;
|
inout [14:0] ddr_addr;
|
||||||
input sys_clk_p;
|
inout [ 2:0] ddr_ba;
|
||||||
input sys_clk_n;
|
inout ddr_cas_n;
|
||||||
|
inout ddr_ck_n;
|
||||||
|
inout ddr_ck_p;
|
||||||
|
inout ddr_cke;
|
||||||
|
inout ddr_cs_n;
|
||||||
|
inout [ 3:0] ddr_dm;
|
||||||
|
inout [31:0] ddr_dq;
|
||||||
|
inout [ 3:0] ddr_dqs_n;
|
||||||
|
inout [ 3:0] ddr_dqs_p;
|
||||||
|
inout ddr_odt;
|
||||||
|
inout ddr_ras_n;
|
||||||
|
inout ddr_reset_n;
|
||||||
|
inout ddr_we_n;
|
||||||
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||||||
output [13:0] DDR3_addr;
|
inout fixed_io_ddr_vrn;
|
||||||
output [ 2:0] DDR3_ba;
|
inout fixed_io_ddr_vrp;
|
||||||
output DDR3_cas_n;
|
inout [53:0] fixed_io_mio;
|
||||||
output [ 0:0] DDR3_ck_n;
|
inout fixed_io_ps_clk;
|
||||||
output [ 0:0] DDR3_ck_p;
|
inout fixed_io_ps_porb;
|
||||||
output [ 0:0] DDR3_cke;
|
inout fixed_io_ps_srstb;
|
||||||
output [ 0:0] DDR3_cs_n;
|
|
||||||
output [ 7:0] DDR3_dm;
|
|
||||||
inout [63:0] DDR3_dq;
|
|
||||||
inout [ 7:0] DDR3_dqs_n;
|
|
||||||
inout [ 7:0] DDR3_dqs_p;
|
|
||||||
output [ 0:0] DDR3_odt;
|
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||||||
output DDR3_ras_n;
|
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||||||
output DDR3_reset_n;
|
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||||||
output DDR3_we_n;
|
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||||||
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inout [14:0] DDR_addr;
|
|
||||||
inout [ 2:0] DDR_ba;
|
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||||||
inout DDR_cas_n;
|
|
||||||
inout DDR_ck_n;
|
|
||||||
inout DDR_ck_p;
|
|
||||||
inout DDR_cke;
|
|
||||||
inout DDR_cs_n;
|
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||||||
inout [ 3:0] DDR_dm;
|
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||||||
inout [31:0] DDR_dq;
|
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||||||
inout [ 3:0] DDR_dqs_n;
|
|
||||||
inout [ 3:0] DDR_dqs_p;
|
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||||||
inout DDR_odt;
|
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||||||
inout DDR_ras_n;
|
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||||||
inout DDR_reset_n;
|
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||||||
inout DDR_we_n;
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||||||
inout FIXED_IO_ddr_vrn;
|
|
||||||
inout FIXED_IO_ddr_vrp;
|
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inout [53:0] FIXED_IO_mio;
|
|
||||||
inout FIXED_IO_ps_clk;
|
|
||||||
inout FIXED_IO_ps_porb;
|
|
||||||
inout FIXED_IO_ps_srstb;
|
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||||||
|
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||||||
inout [14:0] gpio_bd;
|
inout [14:0] gpio_bd;
|
||||||
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||||||
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|
@ -178,6 +158,26 @@ module system_top (
|
||||||
|
|
||||||
output spdif;
|
output spdif;
|
||||||
|
|
||||||
|
input sys_rst;
|
||||||
|
input sys_clk_p;
|
||||||
|
input sys_clk_n;
|
||||||
|
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||||||
|
output [13:0] ddr3_addr;
|
||||||
|
output [ 2:0] ddr3_ba;
|
||||||
|
output ddr3_cas_n;
|
||||||
|
output [ 0:0] ddr3_ck_n;
|
||||||
|
output [ 0:0] ddr3_ck_p;
|
||||||
|
output [ 0:0] ddr3_cke;
|
||||||
|
output [ 0:0] ddr3_cs_n;
|
||||||
|
output [ 7:0] ddr3_dm;
|
||||||
|
inout [63:0] ddr3_dq;
|
||||||
|
inout [ 7:0] ddr3_dqs_n;
|
||||||
|
inout [ 7:0] ddr3_dqs_p;
|
||||||
|
output [ 0:0] ddr3_odt;
|
||||||
|
output ddr3_ras_n;
|
||||||
|
output ddr3_reset_n;
|
||||||
|
output ddr3_we_n;
|
||||||
|
|
||||||
inout iic_scl;
|
inout iic_scl;
|
||||||
inout iic_sda;
|
inout iic_sda;
|
||||||
|
|
||||||
|
|
@ -218,14 +218,20 @@ module system_top (
|
||||||
|
|
||||||
// internal signals
|
// internal signals
|
||||||
|
|
||||||
wire [37:0] gpio_i;
|
wire [63:0] gpio_i;
|
||||||
wire [37:0] gpio_o;
|
wire [63:0] gpio_o;
|
||||||
wire [37:0] gpio_t;
|
wire [63:0] gpio_t;
|
||||||
|
wire [ 2:0] spi0_csn;
|
||||||
|
wire spi0_clk;
|
||||||
|
wire spi0_mosi;
|
||||||
|
wire spi0_miso;
|
||||||
|
wire [ 2:0] spi1_csn;
|
||||||
|
wire spi1_clk;
|
||||||
|
wire spi1_mosi;
|
||||||
|
wire spi1_miso;
|
||||||
wire rx_ref_clk;
|
wire rx_ref_clk;
|
||||||
wire rx_sysref;
|
wire rx_sysref;
|
||||||
wire rx_sync;
|
wire rx_sync;
|
||||||
wire spi_mosi;
|
|
||||||
wire spi_miso;
|
|
||||||
wire adc_clk;
|
wire adc_clk;
|
||||||
wire [63:0] adc_data_0;
|
wire [63:0] adc_data_0;
|
||||||
wire [63:0] adc_data_1;
|
wire [63:0] adc_data_1;
|
||||||
|
|
@ -239,25 +245,6 @@ module system_top (
|
||||||
wire adc_valid_1;
|
wire adc_valid_1;
|
||||||
wire adc_valid_2;
|
wire adc_valid_2;
|
||||||
wire adc_valid_3;
|
wire adc_valid_3;
|
||||||
wire [255:0] gt_data;
|
|
||||||
wire [15:0] ps_intrs;
|
|
||||||
|
|
||||||
wire [ 6:0] csn;
|
|
||||||
wire [ 2:0] csn_i;
|
|
||||||
|
|
||||||
genvar i;
|
|
||||||
|
|
||||||
generate for (i = 0; i < 7; i = i + 1) begin
|
|
||||||
assign csn[i] = ~(csn_i == i);
|
|
||||||
end endgenerate
|
|
||||||
|
|
||||||
assign ad9528_csn = csn[0];
|
|
||||||
assign ad9234_1_csn = csn[1];
|
|
||||||
assign ad9234_2_csn = csn[2];
|
|
||||||
assign ada4961_1a_csn = csn[3];
|
|
||||||
assign ada4961_1b_csn = csn[4];
|
|
||||||
assign ada4961_1c_csn = csn[5];
|
|
||||||
assign ada4961_1d_csn = csn[6];
|
|
||||||
|
|
||||||
// adc-pack place holder
|
// adc-pack place holder
|
||||||
|
|
||||||
|
|
@ -412,6 +399,17 @@ module system_top (
|
||||||
endcase
|
endcase
|
||||||
end
|
end
|
||||||
|
|
||||||
|
// spi
|
||||||
|
|
||||||
|
assign spi_clk = spi0_clk;
|
||||||
|
assign ad9528_csn = (spi0_csn == 3'b110) ? 1'b0 : 1'b1;
|
||||||
|
assign ad9234_1_csn = (spi0_csn == 3'b101) ? 1'b0 : 1'b1;
|
||||||
|
assign ad9234_2_csn = (spi0_csn == 3'b011) ? 1'b0 : 1'b1;
|
||||||
|
assign ada4961_1a_csn = (spi0_csn == 3'b000) ? 1'b0 : 1'b1;
|
||||||
|
assign ada4961_1b_csn = (spi0_csn == 3'b001) ? 1'b0 : 1'b1;
|
||||||
|
assign ada4961_1c_csn = (spi0_csn == 3'b010) ? 1'b0 : 1'b1;
|
||||||
|
assign ada4961_1d_csn = (spi0_csn == 3'b100) ? 1'b0 : 1'b1;
|
||||||
|
|
||||||
// instantiations
|
// instantiations
|
||||||
|
|
||||||
IBUFDS_GTE2 i_ibufds_rx_ref_clk (
|
IBUFDS_GTE2 i_ibufds_rx_ref_clk (
|
||||||
|
|
@ -437,64 +435,30 @@ module system_top (
|
||||||
.OB (rx_sync_1_n));
|
.OB (rx_sync_1_n));
|
||||||
|
|
||||||
fmcadc4_spi i_spi (
|
fmcadc4_spi i_spi (
|
||||||
.csn (csn),
|
.spi_csn (spi0_csn),
|
||||||
.spi_clk (spi_clk),
|
.spi_clk (spi_clk),
|
||||||
.spi_mosi (spi_mosi),
|
.spi_mosi (spi0_mosi),
|
||||||
.spi_miso (spi_miso),
|
.spi_miso (spi0_miso),
|
||||||
.spi_sdio (spi_sdio));
|
.spi_sdio (spi_sdio));
|
||||||
|
|
||||||
ad_iobuf #(.DATA_WIDTH(21)) i_iobuf (
|
ad_iobuf #(.DATA_WIDTH(6)) i_iobuf (
|
||||||
.dt ({gpio_t[37:32], gpio_t[14:0]}),
|
.dt (gpio_t[37:32]),
|
||||||
.di ({gpio_o[37:32], gpio_o[14:0]}),
|
.di (gpio_o[37:32]),
|
||||||
.do ({gpio_i[37:32], gpio_i[14:0]}),
|
.do (gpio_i[37:32]),
|
||||||
.dio ({ ad9234_2_fdb, // 37
|
.dio ({ ad9234_2_fdb, // 37
|
||||||
ad9234_2_fda, // 36
|
ad9234_2_fda, // 36
|
||||||
ad9234_1_fdb, // 35
|
ad9234_1_fdb, // 35
|
||||||
ad9234_1_fda, // 34
|
ad9234_1_fda, // 34
|
||||||
ad9528_status, // 33
|
ad9528_status, // 33
|
||||||
ad9528_rstn, // 32
|
ad9528_rstn})); // 32
|
||||||
gpio_bd})); // 0
|
|
||||||
|
ad_iobuf #(.DATA_WIDTH(15)) i_iobuf_bd (
|
||||||
|
.dt (gpio_t[14:0]),
|
||||||
|
.di (gpio_o[14:0]),
|
||||||
|
.do (gpio_i[14:0]),
|
||||||
|
.dio (gpio_bd));
|
||||||
|
|
||||||
system_wrapper i_system_wrapper (
|
system_wrapper i_system_wrapper (
|
||||||
.DDR3_addr (DDR3_addr),
|
|
||||||
.DDR3_ba (DDR3_ba),
|
|
||||||
.DDR3_cas_n (DDR3_cas_n),
|
|
||||||
.DDR3_ck_n (DDR3_ck_n),
|
|
||||||
.DDR3_ck_p (DDR3_ck_p),
|
|
||||||
.DDR3_cke (DDR3_cke),
|
|
||||||
.DDR3_cs_n (DDR3_cs_n),
|
|
||||||
.DDR3_dm (DDR3_dm),
|
|
||||||
.DDR3_dq (DDR3_dq),
|
|
||||||
.DDR3_dqs_n (DDR3_dqs_n),
|
|
||||||
.DDR3_dqs_p (DDR3_dqs_p),
|
|
||||||
.DDR3_odt (DDR3_odt),
|
|
||||||
.DDR3_ras_n (DDR3_ras_n),
|
|
||||||
.DDR3_reset_n (DDR3_reset_n),
|
|
||||||
.DDR3_we_n (DDR3_we_n),
|
|
||||||
.DDR_addr (DDR_addr),
|
|
||||||
.DDR_ba (DDR_ba),
|
|
||||||
.DDR_cas_n (DDR_cas_n),
|
|
||||||
.DDR_ck_n (DDR_ck_n),
|
|
||||||
.DDR_ck_p (DDR_ck_p),
|
|
||||||
.DDR_cke (DDR_cke),
|
|
||||||
.DDR_cs_n (DDR_cs_n),
|
|
||||||
.DDR_dm (DDR_dm),
|
|
||||||
.DDR_dq (DDR_dq),
|
|
||||||
.DDR_dqs_n (DDR_dqs_n),
|
|
||||||
.DDR_dqs_p (DDR_dqs_p),
|
|
||||||
.DDR_odt (DDR_odt),
|
|
||||||
.DDR_ras_n (DDR_ras_n),
|
|
||||||
.DDR_reset_n (DDR_reset_n),
|
|
||||||
.DDR_we_n (DDR_we_n),
|
|
||||||
.FIXED_IO_ddr_vrn (FIXED_IO_ddr_vrn),
|
|
||||||
.FIXED_IO_ddr_vrp (FIXED_IO_ddr_vrp),
|
|
||||||
.FIXED_IO_mio (FIXED_IO_mio),
|
|
||||||
.FIXED_IO_ps_clk (FIXED_IO_ps_clk),
|
|
||||||
.FIXED_IO_ps_porb (FIXED_IO_ps_porb),
|
|
||||||
.FIXED_IO_ps_srstb (FIXED_IO_ps_srstb),
|
|
||||||
.GPIO_I (gpio_i),
|
|
||||||
.GPIO_O (gpio_o),
|
|
||||||
.GPIO_T (gpio_t),
|
|
||||||
.adc_clk (adc_clk),
|
.adc_clk (adc_clk),
|
||||||
.adc_data_0 (adc_data_0),
|
.adc_data_0 (adc_data_0),
|
||||||
.adc_data_1 (adc_data_1),
|
.adc_data_1 (adc_data_1),
|
||||||
|
|
@ -511,9 +475,45 @@ module system_top (
|
||||||
.adc_valid_1 (adc_valid_1),
|
.adc_valid_1 (adc_valid_1),
|
||||||
.adc_valid_2 (adc_valid_2),
|
.adc_valid_2 (adc_valid_2),
|
||||||
.adc_valid_3 (adc_valid_3),
|
.adc_valid_3 (adc_valid_3),
|
||||||
.gt_data (gt_data),
|
.ddr3_addr (ddr3_addr),
|
||||||
.gt_data_0 (gt_data[127:0]),
|
.ddr3_ba (ddr3_ba),
|
||||||
.gt_data_1 (gt_data[255:128]),
|
.ddr3_cas_n (ddr3_cas_n),
|
||||||
|
.ddr3_ck_n (ddr3_ck_n),
|
||||||
|
.ddr3_ck_p (ddr3_ck_p),
|
||||||
|
.ddr3_cke (ddr3_cke),
|
||||||
|
.ddr3_cs_n (ddr3_cs_n),
|
||||||
|
.ddr3_dm (ddr3_dm),
|
||||||
|
.ddr3_dq (ddr3_dq),
|
||||||
|
.ddr3_dqs_n (ddr3_dqs_n),
|
||||||
|
.ddr3_dqs_p (ddr3_dqs_p),
|
||||||
|
.ddr3_odt (ddr3_odt),
|
||||||
|
.ddr3_ras_n (ddr3_ras_n),
|
||||||
|
.ddr3_reset_n (ddr3_reset_n),
|
||||||
|
.ddr3_we_n (ddr3_we_n),
|
||||||
|
.ddr_addr (ddr_addr),
|
||||||
|
.ddr_ba (ddr_ba),
|
||||||
|
.ddr_cas_n (ddr_cas_n),
|
||||||
|
.ddr_ck_n (ddr_ck_n),
|
||||||
|
.ddr_ck_p (ddr_ck_p),
|
||||||
|
.ddr_cke (ddr_cke),
|
||||||
|
.ddr_cs_n (ddr_cs_n),
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.ddr_dm (ddr_dm),
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.ddr_dq (ddr_dq),
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.ddr_dqs_n (ddr_dqs_n),
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.ddr_dqs_p (ddr_dqs_p),
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.ddr_odt (ddr_odt),
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.ddr_ras_n (ddr_ras_n),
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.ddr_reset_n (ddr_reset_n),
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.ddr_we_n (ddr_we_n),
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.fixed_io_ddr_vrn (fixed_io_ddr_vrn),
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||||||
|
.fixed_io_ddr_vrp (fixed_io_ddr_vrp),
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||||||
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.fixed_io_mio (fixed_io_mio),
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||||||
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.fixed_io_ps_clk (fixed_io_ps_clk),
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||||||
|
.fixed_io_ps_porb (fixed_io_ps_porb),
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.fixed_io_ps_srstb (fixed_io_ps_srstb),
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.gpio_i (gpio_i),
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||||||
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.gpio_o (gpio_o),
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||||||
|
.gpio_t (gpio_t),
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.hdmi_data (hdmi_data),
|
.hdmi_data (hdmi_data),
|
||||||
.hdmi_data_e (hdmi_data_e),
|
.hdmi_data_e (hdmi_data_e),
|
||||||
.hdmi_hsync (hdmi_hsync),
|
.hdmi_hsync (hdmi_hsync),
|
||||||
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@ -521,36 +521,43 @@ module system_top (
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||||||
.hdmi_vsync (hdmi_vsync),
|
.hdmi_vsync (hdmi_vsync),
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||||||
.iic_main_scl_io (iic_scl),
|
.iic_main_scl_io (iic_scl),
|
||||||
.iic_main_sda_io (iic_sda),
|
.iic_main_sda_io (iic_sda),
|
||||||
.ps_intr_0 (ps_intrs[0]),
|
.ps_intr_00 (1'b0),
|
||||||
.ps_intr_1 (ps_intrs[1]),
|
.ps_intr_01 (1'b0),
|
||||||
.ps_intr_10 (ps_intrs[10]),
|
.ps_intr_02 (1'b0),
|
||||||
.ps_intr_11 (ps_intrs[11]),
|
.ps_intr_03 (1'b0),
|
||||||
.ps_intr_12 (ps_intrs[12]),
|
.ps_intr_04 (1'b0),
|
||||||
.ps_intr_13 (ps_intrs[13]),
|
.ps_intr_05 (1'b0),
|
||||||
.ps_intr_2 (ps_intrs[2]),
|
.ps_intr_06 (1'b0),
|
||||||
.ps_intr_3 (ps_intrs[3]),
|
.ps_intr_07 (1'b0),
|
||||||
.ps_intr_4 (ps_intrs[4]),
|
.ps_intr_08 (1'b0),
|
||||||
.ps_intr_5 (ps_intrs[5]),
|
.ps_intr_09 (1'b0),
|
||||||
.ps_intr_6 (ps_intrs[6]),
|
.ps_intr_10 (1'b0),
|
||||||
.ps_intr_7 (ps_intrs[7]),
|
.ps_intr_11 (1'b0),
|
||||||
.ps_intr_8 (ps_intrs[8]),
|
.ps_intr_12 (1'b0),
|
||||||
.ps_intr_9 (ps_intrs[9]),
|
|
||||||
.fmcadc4_dma_intr (ps_intrs[12]),
|
|
||||||
.rx_data_n (rx_data_n),
|
.rx_data_n (rx_data_n),
|
||||||
.rx_data_p (rx_data_p),
|
.rx_data_p (rx_data_p),
|
||||||
.rx_ref_clk (rx_ref_clk),
|
.rx_ref_clk (rx_ref_clk),
|
||||||
.rx_sync (rx_sync),
|
.rx_sync (rx_sync),
|
||||||
.rx_sysref (rx_sysref),
|
.rx_sysref (rx_sysref),
|
||||||
.spdif (spdif),
|
.spdif (spdif),
|
||||||
.spi_clk_i (spi_clk),
|
.spi0_clk_i (spi0_clk),
|
||||||
.spi_clk_o (spi_clk),
|
.spi0_clk_o (spi0_clk),
|
||||||
.spi_csn_i (1'b1),
|
.spi0_csn_0_o (spi0_csn[0]),
|
||||||
.spi_csn_0_o (csn_i[0]),
|
.spi0_csn_1_o (spi0_csn[1]),
|
||||||
.spi_csn_1_o (csn_i[1]),
|
.spi0_csn_2_o (spi0_csn[2]),
|
||||||
.spi_csn_2_o (csn_i[2]),
|
.spi0_csn_i (1'b1),
|
||||||
.spi_sdi_i (spi_miso),
|
.spi0_sdi_i (spi0_miso),
|
||||||
.spi_sdo_i (spi_mosi),
|
.spi0_sdo_i (spi0_mosi),
|
||||||
.spi_sdo_o (spi_mosi),
|
.spi0_sdo_o (spi0_mosi),
|
||||||
|
.spi1_clk_i (spi1_clk),
|
||||||
|
.spi1_clk_o (spi1_clk),
|
||||||
|
.spi1_csn_0_o (spi1_csn[0]),
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||||||
|
.spi1_csn_1_o (spi1_csn[1]),
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|
.spi1_csn_2_o (spi1_csn[2]),
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||||||
|
.spi1_csn_i (1'b1),
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||||||
|
.spi1_sdi_i (1'b1),
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.spi1_sdo_i (spi1_mosi),
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||||||
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.spi1_sdo_o (spi1_mosi),
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||||||
.sys_clk_clk_n (sys_clk_n),
|
.sys_clk_clk_n (sys_clk_n),
|
||||||
.sys_clk_clk_p (sys_clk_p),
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.sys_clk_clk_p (sys_clk_p),
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.sys_rst (sys_rst));
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.sys_rst (sys_rst));
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