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usdrx1-xcvr add_instance axi_usdrx1_xcvr axi_adxcvr set_instance_parameter_value axi_usdrx1_xcvr {ID} {0} set_instance_parameter_value axi_usdrx1_xcvr {TX_OR_RX_N} {0} set_instance_parameter_value axi_usdrx1_xcvr {NUM_OF_LANES} {8} add_connection sys_clk.clk axi_usdrx1_xcvr.s_axi_clock add_connection sys_clk.clk_reset axi_usdrx1_xcvr.s_axi_reset add_connection axi_usdrx1_xcvr.if_up_rst avl_usdrx1_xcvr.rst add_connection avl_usdrx1_xcvr.ready axi_usdrx1_xcvr.ready add_connection axi_usdrx1_xcvr.core_pll_locked avl_usdrx1_xcvr.core_pll_locked # ad9671 add_instance axi_ad9671_core_0 axi_ad9671 set_instance_parameter_value axi_ad9671_core_0 {ID} {0} set_instance_parameter_value axi_ad9671_core_0 {QUAD_OR_DUAL_N} {0} add_connection avl_usdrx1_xcvr.core_clk axi_ad9671_core_0.if_rx_clk add_interface rx_ip_sof_0 conduit end set_interface_property rx_ip_sof_0 EXPORT_OF axi_ad9671_core_0.if_rx_sof add_interface rx_ip_data_0 avalon_streaming sink set_interface_property rx_ip_data_0 EXPORT_OF axi_ad9671_core_0.if_rx_data add_connection sys_clk.clk_reset axi_ad9671_core_0.s_axi_reset add_connection sys_clk.clk axi_ad9671_core_0.s_axi_clock add_interface rx_core_ch_0 conduit end set_interface_property rx_core_ch_0 EXPORT_OF axi_ad9671_core_0.adc_ch add_interface rx_core_sync_0 conduit end set_interface_property rx_core_sync_0 EXPORT_OF axi_ad9671_core_0.if_sync add_interface rx_core_ovf_0 conduit end set_interface_property rx_core_ovf_0 EXPORT_OF axi_ad9671_core_0.if_adc_dovf add_interface rx_core_unf_0 conduit end set_interface_property rx_core_unf_0 EXPORT_OF axi_ad9671_core_0.if_adc_dunf add_instance axi_ad9671_core_1 axi_ad9671 set_instance_parameter_value axi_ad9671_core_1 {ID} {1} set_instance_parameter_value axi_ad9671_core_1 {QUAD_OR_DUAL_N} {0} add_connection avl_usdrx1_xcvr.core_clk axi_ad9671_core_1.if_rx_clk add_interface rx_ip_sof_1 conduit end set_interface_property rx_ip_sof_1 EXPORT_OF axi_ad9671_core_1.if_rx_sof add_interface rx_ip_data_1 avalon_streaming sink set_interface_property rx_ip_data_1 EXPORT_OF axi_ad9671_core_1.if_rx_data add_connection sys_clk.clk_reset axi_ad9671_core_1.s_axi_reset add_connection sys_clk.clk axi_ad9671_core_1.s_axi_clock add_interface rx_core_ch_1 conduit end set_interface_property rx_core_ch_1 EXPORT_OF axi_ad9671_core_1.adc_ch add_interface rx_core_sync_1 conduit end set_interface_property rx_core_sync_1 EXPORT_OF axi_ad9671_core_1.if_sync add_interface rx_core_ovf_1 conduit end set_interface_property rx_core_ovf_1 EXPORT_OF axi_ad9671_core_1.if_adc_dovf add_interface rx_core_unf_1 conduit end set_interface_property rx_core_unf_1 EXPORT_OF axi_ad9671_core_1.if_adc_dunf add_instance axi_ad9671_core_2 axi_ad9671 set_instance_parameter_value axi_ad9671_core_2 {ID} {2} set_instance_parameter_value axi_ad9671_core_2 {QUAD_OR_DUAL_N} {0} add_connection avl_usdrx1_xcvr.core_clk axi_ad9671_core_2.if_rx_clk add_interface rx_ip_sof_2 conduit end set_interface_property rx_ip_sof_2 EXPORT_OF axi_ad9671_core_2.if_rx_sof add_interface rx_ip_data_2 avalon_streaming sink set_interface_property rx_ip_data_2 EXPORT_OF axi_ad9671_core_2.if_rx_data add_connection sys_clk.clk_reset axi_ad9671_core_2.s_axi_reset add_connection sys_clk.clk axi_ad9671_core_2.s_axi_clock add_interface rx_core_ch_2 conduit end set_interface_property rx_core_ch_2 EXPORT_OF axi_ad9671_core_2.adc_ch add_interface rx_core_sync_2 conduit end set_interface_property rx_core_sync_2 EXPORT_OF axi_ad9671_core_2.if_sync add_interface rx_core_ovf_2 conduit end set_interface_property rx_core_ovf_2 EXPORT_OF axi_ad9671_core_2.if_adc_dovf add_interface rx_core_unf_2 conduit end set_interface_property rx_core_unf_2 EXPORT_OF axi_ad9671_core_2.if_adc_dunf add_instance axi_ad9671_core_3 axi_ad9671 set_instance_parameter_value axi_ad9671_core_3 {ID} {3} set_instance_parameter_value axi_ad9671_core_3 {QUAD_OR_DUAL_N} {0} add_connection avl_usdrx1_xcvr.core_clk axi_ad9671_core_3.if_rx_clk add_interface rx_ip_sof_3 conduit end set_interface_property rx_ip_sof_3 EXPORT_OF axi_ad9671_core_3.if_rx_sof add_interface rx_ip_data_3 avalon_streaming sink set_interface_property rx_ip_data_3 EXPORT_OF axi_ad9671_core_3.if_rx_data add_connection sys_clk.clk_reset axi_ad9671_core_3.s_axi_reset add_connection sys_clk.clk axi_ad9671_core_3.s_axi_clock add_interface rx_core_ch_3 conduit end set_interface_property rx_core_ch_3 EXPORT_OF axi_ad9671_core_3.adc_ch add_interface rx_core_sync_3 conduit end set_interface_property rx_core_sync_3 EXPORT_OF axi_ad9671_core_3.if_sync add_interface rx_core_ovf_3 conduit end set_interface_property rx_core_ovf_3 EXPORT_OF axi_ad9671_core_3.if_adc_dovf add_interface rx_core_unf_3 conduit end set_interface_property rx_core_unf_3 EXPORT_OF axi_ad9671_core_3.if_adc_dunf # usdrx1-fifo add_instance usdrx1_adcfifo util_adcfifo set_instance_parameter_value usdrx1_adcfifo {ADC_DATA_WIDTH} {512} set_instance_parameter_value usdrx1_adcfifo {DMA_DATA_WIDTH} {512} set_instance_parameter_value usdrx1_adcfifo {DMA_ADDRESS_WIDTH} {10} add_connection sys_clk.clk_reset usdrx1_adcfifo.if_adc_rst add_connection sys_dma_clk.clk_reset usdrx1_adcfifo.if_adc_rst add_connection avl_usdrx1_xcvr.core_clk usdrx1_adcfifo.if_adc_clk add_interface rx_ch_wr conduit end set_interface_property rx_ch_wr EXPORT_OF usdrx1_adcfifo.if_adc_wr add_interface rx_ch_wdata conduit end set_interface_property rx_ch_wdata EXPORT_OF usdrx1_adcfifo.if_adc_wdata add_interface rx_ch_wovf conduit end set_interface_property rx_ch_wovf EXPORT_OF usdrx1_adcfifo.if_adc_wovf add_connection sys_dma_clk.clk usdrx1_adcfifo.if_dma_clk # usdrx1-dma add_instance axi_usdrx1_dma axi_dmac set_instance_parameter_value axi_usdrx1_dma {ID} {0} set_instance_parameter_value axi_usdrx1_dma {DMA_TYPE_SRC} {1} set_instance_parameter_value axi_usdrx1_dma {DMA_TYPE_DEST} {0} set_instance_parameter_value axi_usdrx1_dma {SYNC_TRANSFER_START} {1} set_instance_parameter_value axi_usdrx1_dma {DMA_LENGTH_WIDTH} {24} set_instance_parameter_value axi_usdrx1_dma {DMA_DATA_WIDTH_SRC} {512} set_instance_parameter_value axi_usdrx1_dma {DMA_DATA_WIDTH_DEST} {512} add_connection sys_dma_clk.clk axi_usdrx1_dma.if_s_axis_aclk add_connection usdrx1_adcfifo.if_dma_wr axi_usdrx1_dma.if_s_axis_valid add_connection usdrx1_adcfifo.if_dma_wdata axi_usdrx1_dma.if_s_axis_data add_connection usdrx1_adcfifo.if_dma_wready axi_usdrx1_dma.if_s_axis_ready add_connection usdrx1_adcfifo.if_dma_xfer_req axi_usdrx1_dma.if_s_axis_xfer_req add_connection sys_clk.clk_reset axi_usdrx1_dma.s_axi_reset add_connection sys_clk.clk axi_usdrx1_dma.s_axi_clock add_connection sys_dma_clk.clk_reset axi_usdrx1_dma.m_dest_axi_reset add_connection sys_dma_clk.clk axi_usdrx1_dma.m_dest_axi_clock # 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