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TITLE
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IO Delay Control (axi_ad*)
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IO_DELAY_CNTRL
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ENDTITLE
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REG
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0x00
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REG_DELAY_CONTROL_0
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Delay Control & Status
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ENDREG
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FIELD
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[4:0] 0x00
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DELAY_CONTROL_IO_0
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RW
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Tap value for input/output delay primitive of the first interface line. If the delay controller is
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not locked (indicate issues with delay_clk), the read-back value of this register will be 0xFFFFFFFF.
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Otherwise will be the last set up value.
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ENDFIELD
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REG
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0x01
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REG_DELAY_CONTROL_1
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Delay Control & Status
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ENDREG
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FIELD
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[4:0] 0x00
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DELAY_CONTROL_IO_1
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RW
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Tap value for input/output delay primitive of the second interface line. If the delay controller is
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not locked (indicate issues with delay_clk), the read-back value of this register will be 0xFFFFFFFF.
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Otherwise will be the last set up value.
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ENDFIELD
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REG
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0x02
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REG_*
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Tap value for input/output delay primitive of the third interface line.
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ENDREG
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REG
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0x03
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REG_*
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Tap value for input/output delay primitive of the fourth interface line.
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ENDREG
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REG
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0x0F
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REG_DELAY_CONTROL_F
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Delay Control & Status
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ENDREG
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FIELD
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[4:0] 0x00
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DELAY_CONTROL_IO_F
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RW
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Tap value for input/output delay primitive of the last interface line. In general the data and frame
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lines are controlled with delay primitives, the number of registers of a controller is device
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specific.
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ENDFIELD
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